Practicas de Circuitos Secuenciales

Profesor Ren Jorge Alonso Tllez Academia de Electrnica Digital Turno Matutino

PRACTICA DE SECUENCIALES
PRCTICA No. 1 ESTUDIO DE LOS LATCHS OBJETIVOS Obtener las tablas de verdad de los Flip Flop: RS, D, JK y T. Identificar las diferencias entre un Flip-Flop y un _latch_ de tipo D. Observar el efecto del reloj en los Flip Flop temporizados y la sincrona de entrada _salidas. INTRODUCCIN Los circuitos combinatorios son parte fundamental de los sistemas digitales; pero en la mayora de las aplicaciones se requieren de elementos de memoria que complementen el procesamiento de la informacin. Los sistemas que contemplan parte combinatoria y los elementos de memoria se les conoce como _circuitos secuenciale En un sistema de este tipo, la salida presente no depende slo de la combinacin presente a la entrada, sino de la secuencia en que se hayan aplicado los valores de entrada anteriores. Estos estados son almacenados precisamente en los elementos de memoria antes mencionados.
ENT PRIMARIA SAL

CIRCUITO COMBINATORIO

PRIMARIA

ENTRADA

SALIDA SECUNDARIA

MEMORIA
ENTRADA SECUNDARIA

Figura 1.1 Diagrama a bloques de un circuito secuencial Como se observa en la figura 1.1, el circuito secuencial consta de un lazo de
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retroalimentacin, que toma informacin de algn punto del circuito, lo memoriza y la presenta en la entrada de tal forma que el funcionamiento se basa en una secuencia de informaciones que en conjunto, determinan las salidas presentes. MATERIAL Y EQUIPO EMPLEADO Cantidad 1 1 1 1 1 1 2 2 2 1 1 1 1 Pre-reporte: Investigar los diagramas esquemticos de los C.I. utilizados en estas prcticas, as como sus tablas de verdad. Llevar por lo menos 5 hojas cuadriculadas. Para la segunda parte, traer implementado con el CI 7476, el circuito generador de combinaciones de la figura 1.2 . mediante resistencias de 220 ohms Descripcin

Fuente de alimentacin de 5 VDC CI SN 7402 CI SN 7408 CI SN 7474 CI SN 7475 CI SN 7476 LED_S Resistores de 220, 330, 470 560 ohms, W. Resistores de 1K,2.2K o 3.9 k ohms, W. Microswith de 8P8T Protoboards Probador Lgico Generador de Funciones Osciloscopio.

SW2
SW-SPDT 2 7

U1:A
Q 15 9 6 J

U1:B
Q 11

J CLK

1 16

CLK R K Q 10

14

12

7476

7476

SW1

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B1

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Figura 1.2 Circuito generador de Combinaciones. DESARROLLO Primera parte: Latchs o Cerrojos bsicos con compuertas 1.- Implemente el circuito de la figura 1.3. Colocando Leds a las salidas polarizados mediante resistencias.

R3
1k

R4
1k

U1:A
2 1 3

R S
5 4

U1:B
6

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R2
100

R1
100

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Q'

D1

D2

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Figura 1.3: Celda bsica _RS_ con compuertas NOR_s. 2. Obtenga la tabla de verdad caracterstica y anote los resultados en la tabla 1.1 NOTA : Verifique siempre las condiciones iniciales. S 0 0 1 1 R 0 1 0 1 Q Q

Latchs bsica _RS_ temporizada 3. Modifique el circuito de la figura 1.3 para obtener el circuito de la figura 1.4.

U2:A
1

U1:A
3 2 1 3

R3
1k

R4
1k

R5
1k

2 7408

CLS S R
U2:B
4 6 5 6 5

U1:B
4

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7408

R2
100

R1
100

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Q'

D1

D2

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Figura 1.4: Celda bsica _RS_ temporizada. 4. Obtenga la tabla de verdad, para este circuito. Simule el pulso de reloj con el interruptor CLK. Anote los resultados en la tabla 1.2. Compare las dos tablas: Cul es la diferencia?. Concluya. CLK=0 S 0 0 1 1 R 0 1 0 1 Q Q Q CLK=1 Q

Tabla 1.2: Tabla de verdad para la celda _RS_ temporizada.

Flip_Flop D activado por nivel (latch) 5. Modifique el circuito de la figura 1.4 para obtener el _latch_ tipo _D_ de la figura 1.5. Conecte sus entradas como se indica y coloque LEDs a las salidas, polarizados mediante resistencias de 220 .
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CLK 0 0 1 1

D 0 1 0 1

U1:C
8 10 1

U2:A
3 2 2

U1:A
1 3

R3
1k

R4
1k

9 7402 7408

CLK D
4 6 5 7408 6

U2:B

U1:B
5 4

R2
100

R1
100

Q'

D1

D2

Figura 1.5: Flip-Flop tipo _D_ activado por nivel.

6. Obtenga la tabla de verdad caracterstica, teniendo cuidado de establecer en el circuito las condiciones iniciales correctas. Anote los resultados en la tabla 1.3.

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Tabla 1.3: Tabla de verdad para el _latch D_. 7. Invierta las entradas D y CLK y repita el paso 6. Analice y concluya. Segunda parte: Circuitos integrados Flip-Flops y latch_s Latch _D_ y Flip-Flop _D_ Los conceptos de _latch_ y Flip-Flop a veces son tomados (errneamente) como sinnimos. La principal diferencia radica en que un _latch_ responde al nivel (ya sea alto o bajo) de una seal de reloj, mientras que un Flip-Flop solo lo hace nicamente en las transiciones (ascendentes o descendentes). 8. Con los CI_s 74LS74 y 74LS75, implemente el circuito mostrado en la figura 1.6, verificando que las seales asncronas se conectan correctamente.

U1
2 3 6 7 D0 D1 D2 D3 E0/1 E2/3 74LS75 10 7476 Q0 Q0 Q1 Q1 Q2 Q2 Q3 Q3 16 1 15 14 10 11 9 8

A 5 VOLTS
SW1

J CLK

J CLK

4 1 16

15

9 6

U1:A

U1:B
Q 11

13 4

14 7476

12

C
2 D 3

U2:A
Q 5

13

CLK R Q 6 74LS74

Figura 1.6: Flip-Flop y _latch_ de tipo _D_. 9. Aplique con el generador una seal TTL de 10 KHz y con la ayuda del osciloscopio, elabore el diagrama de tiempo que contenga las salidas del generador (entradas _D_, _E_ y CLK) y las salidas _Q_s_ del _latch y del Flip-Flop. Dibjelas en hojas cuadriculadas. Flip-Flop _JK_
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A 5 VOLTS
2 7

U1:A
Q 15 9 6 J

U1:B
Q 11 J CLK R K Q S 4 1 Q 2

U2:A
15

J CLK

1 16

CLK R K Q 10

14

12

C la figura 1.7. Conecte 10. Con el CI 7476 implemente el Flip_Flop tipo _JK_ mostrado en SW1 las entradas clear y preset en estado alto.
3 3 7476 8 7476

16

14

7476

13

Figura 1.7: Flip-Flop tipo _JK_ 11. Con ayuda del osciloscopio, realice un diagramas de tiempo con CLK, J, y Q; dibuje en papel cuadriculado. NOTA: Recuerde verificar en estos circuitos, la presencia de los flancos y no el pulso. 12. Intercambie las entradas J y K realice un nuevo diagrama de tiempos. Analice y concluya.

Flip_Flop Tipo _T_ 13. Interconecte las dos entradas J y K del circuito de las figuras 1.7, para convertirlo en un Flip_Flop tipo _T_, y conecte esta entrada a la salida B del generador de combinaciones.

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14. Con el nuevo circuito, obtenga el diagrama de tiempos. 15. Invierta las entradas T y CLK y obtenga un nuevo diagrama de tiempo. Analice y concluya. ACTIVIDADES COMPLEMENTARIAS 1.- Describa la operacin del circuito de la figura 1.8. Podra funcionar como un Flip_Flop?.
U1:A

1 3 2 74136

?
U1:B
4

5 74136

Figura 1.8: Circuito de anlisis

Explique como podra usarse para simular el resultado de lanzar al aire una moneda. Suponga que Q = 0 significa que ha cado _sello_ y que Q = 1 _guila_. 2. Qu observaciones hara respecto a los pulsos de reloj de los Flip_Flops estudiados? 3. Cul es la razn por la cual no se analiz a los Flip_Flop tipo _JK_ y _T_ en SSI, usando interruptores a las entradas?
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4. Simule los Flip_Flops tipo _RS_ y _D_ con compuertas NAND en el paquete computacional EWB4. Concluya al respecto, comparando con los resultados de la prctica. 5. Analice el circuito generador de combinaciones. Qu tipo de circuitos utiliza?, En qu estado trabaja?.

PRACTICA N 2 EL FLIP-FLOP OBJETIVO: TRABAJO PREPARATORIO a. Dibuje la constitucin de los Flip-Flops internos que forman el circuito integrado 74112.
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b. Identifique todos sus terminales. c. Cuntos FF tiene internamente. 4. COMPETENCIA: Verifica la operacin del FF JK con entradas asincrnicas y sincrnicas aplicando seales lgicas con normas que conserven el buen estado de los componentes. 5. MATERIALES Y EQUIPOS 2 Diodo emisor de luz. 1 Fuente 5Vcc. 1 CI 74112 1 Protoboard. 1 Resistencia de 330 Cables de conexin. Herramientas de punta, corte y voltmetro 6. PROCEDIMIENTO a. Arme el circuito de la figura 1.

Figura 1. Esquema bsico del FF JK. b. Realice la combinacin para las entradas R y S utilizando el DSW1 para los valores de la tabla 1 y escriba el resultado que se obtiene en la salida Q y Q. c. Conecte R y S a 1logico (utilice el DSW1) d. Inyecte una seal de reloj (1 Hz) y realice las combinaciones para J y K segn indica la tabla
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2. Anote el resultado en la misma tabla. e. Conecte J y K a 1 lgico Inyecte la seal de reloj. Conecte R = 0 y S = 1. Observe la salida. Qu sucede? f. Conecte J y K a 1 lgico. Inyecte la seal de reloj. Conecte R = 1 y S = 0. Observe la salida. Qu sucede? g. Inyecte una seal de reloj a la entrada CLK. Conecte J y K a alto (Vcc). Observe la operacin de la salida. h. Arme el circuito de la figura 2.

J CLK

J CLK

3 1 2

11 13

10

U1:A

U1:B
Q 9

15

74LS112

14

12

74LS112

R1
100

R2
100

D1
LED-RED

D2
LED-RED

Figura 2. Contador binario ascendente. i. Complete la tabla 3, con los valores del contador binario.

j. Arme el circuito de la figura 3.

J CLK

J CLK

3 1 2

11 13

10

U2:A

U2:B
Q 9

15

74LS112

14

12

74LS112

R4
100

R3
100

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D4
LED-RED

D3
LED-RED

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Figura 3. Contador binario ascendente. k. Observe detenidamente el funcionamiento y complete la tabla de verdad (tabla 4). 7. RESULTADOS Y ANALISIS a. Tabla 1. Efecto de las seales R y S en el FF. S 0 0 1 1 R 0 1 0 1 Q Q RESULTADO

b. Escriba en la tabla 1, columna RESULTADO los casos AMBIGUO Y SIN EFECTO (NO CAMBIA). c. Tabla 2. Efecto de las seales J y K en el FF

J 0 0 1 1
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K 0 1 0 1

Q RESULTADO

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d. Escriba en la tabla 2, columna RESULTADO los casos CAMBIA, NOCAMBIA. e. Tabla 3. Contador binario ascendente. QB QA

f. Tabla 4. Contador binario descendente. QB QA

8. CUESTIONARIO a. Para operacin normal de las entradas J y K las entradas R y S se deben conectar en a) alto, b) bajo, c) cualquier valor. b. Como determina el estado AMBIGUO en el FF? c. Como determina el estado NO CAMBIA en el FF? d. Cul es la funcin de la entrada de reloj en el FF? e. Tiene algn efecto la seal de reloj en las entradas asincrnicas. f. Qu entradas tiene mayor prioridad en la salida del FF: a) sincrnicas, b) asincrnicas, c) Slo la J, d) Ninguna. g. Disee un contador descendente MOD-16. 9. CONCLUSIONES

PRCTICA No. 3 FUNCIONAMINTO DEL 555 EN EL MODO AESTABLE

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OBJETIVOS Analizar la operacin del 555 en el modo astable. Observar cmo vara la frecuencia de la salida en funcin de los componentes externos MATERIAL: 1 Circuito integrado 555 1 resistencia de 10k (R1) 1 Preset de 100k 1 Resistencia de 100 0 220 ohms 1 Capacitor de 10uf 16 volts electrolitico 1 LED 1Fuente de 5 volts Manual del 555 Descripcin del circuito En la figura 1 se muestra el circuito que vamos a utilizar en este experimento para comprobar la operacin del 555 en el modo estable (reloj). La resistencia R1 y POT1 y el condensador C1 establecen las caractersticas de la seal de salida. Para detectar la presencia de pulsos se utiliza el monitor lgico formado por el LED y la resistencia R3. Cuando la salida es alta D1 se prende y cuando es baja se apaga. Como resultado el LED parpadea a una determinada frecuencia, ajustable mediante el potencimetro POT1 Procedimiento Paso1 Arme sobre su protoboard del circuito de la figura 1. Conecte el potencimetro POT 1 mediante con alambres del calibre adecuado, con todos los componentes que se piden para su buen funcionamiento. Tenga cuidado en la polarizacin del 555

Paso2. Ya amado su circuito y polarizado observe como esta parpadeando el LED, varie el POT1 y observe como esta variando la frecuencia de trabajo.
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5 VOLTLS USE SU FUENTE

R1
10k

VCC

RV1
50%

U1
Q DC 3 7

5 100k 2

CV

R2
GND TR TH 6 555 220

C1
4.7uf

D1

Figura 1 Circuito Astable con el 555 y sus componentes.

Conclusiones

PRCTICA No. 4 SISTEMAS SECUENCIALES: CONTADORES SNCRONOS Y ASNCRONOS

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1.- OBJETIVOS - Comprobar los modos de funcionamiento de un contador sncrono y uno asncrono. - Realizar un montaje de un contador sncrono y un contador asncrono. - Comprobar la necesidad de utilizar un circuito que evite los _rebotes_ en un pulsador mecnico. - Verificar el funcionamiento de los circuitos utilizando un analizador lgico. 2.- TAREAS PREVIAS A LA ASISTENCIA AL LABORATORIO - Lectura de la prctica. - Estudio de contadores sncronos y asncronos. Modos de funcionamiento y seales de control - Diseo de los montajes. - Lectura del manual de manejo del analizador lgico 3.- DESARROLLO DE LA PRCTICA 3.1.- Montaje del sistema y verificacin Montar y comprobar el funcionamiento del contador asncrono de 4 bits (74LS197). Utilizar como seal de reloj la salida TTL del generador de funciones. Verificar el funcionamiento del contador utilizando el analizador lgico como analizador temporal y en modo de adquisicin automtico (sin condicin de disparo). Observar la aparicin de estados transitorios en las salidas del contador. Comprobar los tiempos de propagacin y compararlos con los proporcionados por el fabricante. Las seales de control y los datos de carga en paralelo se conectarn a las salidas de los micro interruptores de la placa de entrada/salida. Modificar el montaje anterior para comprobar el funcionamiento del contador sncrono reversible de 4 bits (74LS169B). Comprobar el modo de contaje ascendente y descendente. Observar las diferencias con el contador asncrono

4.- MATERIAL PARA LA REALIZACIN DE LA PRCTICA Circuitos Integrados: Unidades Modelo Descripcin
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1 1 1 1 74LS197 74LS169B 74LS14 74LS00 Contador asncrono de 4 bits. Contador sncrono reversible de 4 bits. 6 inversores con histresis 4 puertas NAND de 2 entradas.

PRACTICA N 5

Registros de Almacenamiento y de Corrimiento Objetivo:

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Comprobar el funcionamiento de los registros de almacenamiento y de corrimiento como elementos que almacenan y, en el caso del registro de corrimiento, modifican informacin binaria Introduccin Un registro es un conjunto de flip-flops interconectados de tal manera que funcionan como una unidad que puede almacenar y, en algunos casos manipular, informacin binaria. Los registros bsicos son:
l El l El

registro de almacenamiento registro de corrimiento

En esta prctica implementars un registro de almacenamiento y un registro de corrimiento Actividades 1.- Registro de Almacenamiento La siguiente figura muestra un registro de almacenamiento:

1D=1,

2D=0,

3D=1 y

4D=0.

OK ___

Conecta temporalmente el pulso del reloj (pin 3 del NE555) al pin 11 del 273 (Clock) y djalo conectado el tiempo suficiente para que el reloj complete un ciclo.

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Una vez completado el ciclo, desconecta el pin3 del NE555. Las salidas 1Q a 4Q deben tomar el valor de su entrada respectiva Escritura Ok ___ 1.2) Lectura del dato Si todo funcion correctamente, el dato 1010 debe permanecer en las salidas del registro, an cuando modifiques los valores de las entradas 1Q a 4Q. Lectura Ok ___ b) Ahora definan otro dato de 4 bits a almacenar al registro y repitan los pasos anteriores. Dato: ____________________ Valores que deben tener las entradas 1D: ____ 2D: _____ 3D: ____ 4D: ____ i) Escritura Ok ___ ii) Lectura Ok ___ 2.- Registro de Corrimiento El registro de corrimiento ms simple se forma conectando en cascada una serie de flip-flops D. La figura siguiente muestra un registro de corrimiento de 3 bits:

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2.1.- Utilizando el 74LS273 construye un registro de corrimiento de 4 bits. Es decir, 1D ser la entrada del registro (la seal X en la figura anterior) , 1Q se conecta a 2D, 2Q se conecta a 3D, y 3Q se conecta a 4D. Las salidas del registro sern 1Q, 2Q, 3Q y 4Q. Registro de corrimiento de 4 bits implementado: Ok ___ 2.2 Escritura al registro de corrimiento. La entrada al registro de corrimiento implementado es serial, es decir se coloca el primer bit del dato (el bit menos significativo) y se aplica un pulso de reloj, se coloca el siguiente bit y se aplica un segundo pulso del reloj, y esto se repite sucesivamente hasta que se coloca el bit ms significativo y se aplica por ltima vez el pulso del reloj. a) Escritura del dato 0101. Para escribir este dato debes realizar los siguientes pasos: Coloca 1D = 1 y aplica un primer pulso de reloj al 273 Ok __ Coloca 1D = 0 y aplica un segundo pulso de reloj al 273 Ok __ Coloca 1D = 1 y aplica un tercer pulso de reloj al 273 Ok __ Coloca 1D = 0 y aplica un cuarto y ltimo pulso de reloj al 273 Ok __ Si todo funcion correctamente, ahora 1Q .. 4Q = 0101 Escritura correcta Ok ___ dicho dato al registro de corrimiento

Nuevo dato: _________

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Valor que debe tener 1D para el primer pulso 1D = ___ Valor que debe tener 1D para el segundo pulso 1D = ___ Valor que debe tener 1D para el tercer pulso 1D = ___ Valor que debe tener 1D para el cuarto y ltimo pulso 1D = ___ Escritura correcta Ok ___ Lectura correcta Ok ___ Comentarios y conclusiones

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