INFORME N5 Casimiro
INFORME N5 Casimiro
INFORME N5 Casimiro
INFORME 5
Curso:
CIRCUITOS DIGITALES
Tema:
INFORME 5
Profesor:
ALARCÓN MATUTTI
Alumna:
LIMA – PERU
INFORME N°5:
- Usando el programa elegido de simulador VHDL, se pide escribir el código VHDL compilar y
simular para verificar su funcionamiento.
- Explicar el código VHDL incluyendo comentarios en línea.
A) USANDO MULTIPLEXORES CI 74151 Y ALGUNAS PUERTAS ADICIONALES, DISEÑAR UN
MULTIPLEXOR 64 A 1. SE PIDE:
- RESUMEN DE LA HOJA DE DATOS TÉCNICOS DEL CI. BUSCAR EN INTERNET EL “DATA
SHEET”. ENTENDER SU FUNCIONAMIENTO LÓGICO.
- SIMULAR EL EQUIVALENTE LÓGICO DEL CI Y DEFINIRLO COMO SÍMBOLO. INCLUIR EL PIN
DE VCC Y GND CON LA MISMA DISTRIBUCIÓN DE PINES DEL “DATA SHEET”.
- MOSTRAR EL CONEXIONADO Y SIMULAR EL DISEÑO USANDO EL SÍMBOLO DEL CI. EL
CONEXIONADO DEBE SER TAL COMO SE HARÍA EN UN PROTOBOARD REAL.
𝐅(𝐀, 𝐁, 𝐂, 𝐃, 𝐄 ) = ∑ 𝒎(𝟕, 𝟖, 𝟏𝟐, 𝟏𝟑, 𝟏𝟒, 𝟏𝟗, 𝟐𝟑, 𝟐𝟒, 𝟐𝟕, 𝟐𝟗, 𝟑𝟎) + 𝒓(𝟏, 𝟏𝟎, 𝟏𝟕, 𝟐𝟔, 𝟐𝟖, 𝟑𝟏)
A B C D E F
m0 0 0 0 0 0 0
m1 0 0 0 0 1 X
m2 0 0 0 1 0 0 I0
m3 0 0 0 1 1 0
m4 0 0 1 0 0 0
m5 0 0 1 0 1 0
m6 0 0 1 1 0 0 I1
m7 0 0 1 1 1 1
m8 0 1 0 0 0 1
m9 0 1 0 0 1 0
m10 0 1 0 1 0 X I2
m11 0 1 0 1 1 0
m12 0 1 1 0 0 1
m13 0 1 1 0 1 1
m14 0 1 1 1 0 1 I3
m15 0 1 1 1 1 0
m16 1 0 0 0 0 0
m17 1 0 0 0 1 X
m18 1 0 0 1 0 0 I4
m19 1 0 0 1 1 1
m20 1 0 1 0 0 0
m21 1 0 1 0 1 0
m22 1 0 1 1 0 0 I5
m23 1 0 1 1 1 1
m24 1 1 0 0 0 1
m25 1 1 0 0 1 0
m26 1 1 0 1 0 X I6
m27 1 1 0 1 1 1
m28 1 1 1 0 0 X
m29 1 1 1 0 1 1
m30 1 1 1 1 0 1 I7
m31 1 1 1 1 1 X
I7=1
D) DISEÑAR, MEDIANTE PUERTAS LÓGICAS, UN CIRCUITO QUE EN UN VISUALIZADOR DE 07
SEGMENTOS MUESTRE EN CADA CICLO DE RELOJ LA SECUENCIA: 0 1 2 3… 8 9 PERU 0 1
2…. (SE REPITE LA SECUENCIA). USE CONTADOR (CUENTA 0 – 15) PARA GENERAR LA
SECUENCIA AUTOMÁTICA.
E) DISEÑAR UN DESPLAZADOR DE 4 BITS (ROTACIÓN IZQUIERDA) COMO MUESTRA EN LA
TABLA Y SE DEBE CUMPLIR:
ENTRADAS: I3 I2 I1 I0
SALIDAS: Y3 Y2 Y1 Y0
SEÑALES DE CONTROL: R A1 A0
UTILICE MUXS 4:1 Y PUERTAS SIMPLES.
̅̅̅̅. 𝑨𝟎
𝒀𝟑 = 𝑰𝟑. 𝑨𝟏 ̅̅̅̅ + 𝑰𝟐. 𝑹 ̅̅̅̅. 𝑨𝟎 + 𝑰𝟐. 𝑹. 𝑨𝟏
̅ . 𝑨𝟏 ̅̅̅̅. 𝑨𝟎 + 𝑰𝟏. 𝑹 ̅̅̅̅ + 𝑰𝟏. 𝑹. 𝑨𝟏. 𝑨𝟎
̅ . 𝑨𝟏. 𝑨𝟎 ̅̅̅̅ + 𝑰𝟎. 𝑹
̅ . 𝑨𝟏. 𝑨𝟐 + 𝑰𝟎. 𝑹. 𝑨𝟏. 𝑨𝟐
𝒀𝟑 = 𝑰𝟑. ̅̅̅̅
𝑨𝟏. ̅̅̅̅
𝑨𝟎 + 𝑰𝟐. ̅̅̅̅
𝑨𝟏. 𝑨𝟎 + 𝑰𝟏. 𝑨𝟏. ̅̅̅̅
𝑨𝟎 + 𝑰𝟎. 𝑨𝟏. 𝑨𝟐
̅̅̅̅. 𝑨𝟎
𝒀𝟐 = 𝑰𝟑. 𝑹. 𝑨𝟏. 𝑨𝟐 + 𝑰𝟐. 𝑨𝟏 ̅̅̅̅ + 𝑰𝟏. 𝑹 ̅̅̅̅. 𝑨𝟎 + 𝑰𝟏. 𝑹. 𝑨𝟏
̅ . 𝑨𝟏 ̅̅̅̅. 𝑨𝟎 + 𝑰𝟎. 𝑹 ̅̅̅̅ + 𝑰𝟎. 𝑹. 𝑨𝟏. 𝑨𝟎
̅ . 𝑨𝟏. 𝑨𝟎 ̅̅̅̅
𝒀𝟎 = 𝑰𝟑. 𝑹. ̅̅̅̅
𝑨𝟏. 𝑨𝟎 + 𝑰𝟐. 𝑹. 𝑨𝟏. ̅̅̅̅
𝑨𝟎 + 𝑰𝟏. 𝑹. 𝑨𝟏. 𝑨𝟐 + 𝑰𝟎. ̅̅̅̅
𝑨𝟏. ̅̅̅̅
𝑨𝟎
F) DISEÑE UN CODIFICADOR DE PRIORIDAD DE 4 ENTRADAS ACTIVAS EN NIVEL BAJO Y UNA
SALIDA PARA INDICAR QUE NO HAY NINGUNA ENTRADA ACTIVA, COMO SE MUESTRA
EN LA FIGURA:
FUNCIÓN BOOLEANA:
𝑖0 = ̅̅̅
𝐸0
𝑖1 = 𝐸0 . ̅̅̅
𝐸1
𝑖2 = 𝐸0 . 𝐸1 . ̅̅̅
𝐸2
𝑖3 = 𝐸0 . 𝐸1 . 𝐸2 . ̅̅̅
𝐸3
̅̅̅2 + ̅̅̅
𝐴1 = 𝑖2 + 𝑖3 = 𝐸0 . 𝐸1 . (𝐸 𝐸3 )
̅̅̅1 + 𝐸2 . ̅̅̅
𝐴0 = 𝑖1 + 𝑖3 = 𝐸0 . (𝐸 𝐸3 )
𝑌 = 𝐸0 . 𝐸1 . 𝐸2 . 𝐸3
G) REALIZAR LA FUNCIÓN 𝐅 = ∏ 𝐌(𝟎, 𝟐, 𝟒, 𝟔) MEDIANTE:
- MULTIPLEXORES 8:1
A B C F
0 0 0 0
0 0 1 1
0 1 0 0
0 1 1 1
1 0 0 0
1 0 1 1
1 1 0 0
1 1 1 1
- MULTIPLEXOREES 4:1
- DECODIFICADORES 3:8 Y PUERTAS OR
TABLA DE VERDAD:
Z1 Z0 F
0 0 𝑥 ⊕ 𝑦 = 𝑥. 𝑦̅ + 𝑥̅ . 𝑦
0 1 𝑥+𝑦
1 0 𝑥. 𝑦
̅̅̅̅̅
1 1 𝑦̅
FUNCIÓN BOOLEANA: