Ecualizador y Filtro
Ecualizador y Filtro
Ecualizador y Filtro
Yo, Fernando Ramiro Pacheco Cora!, declaro que el trabajo aquí descrito es de mi
autoría; que no ha sido previamente presentado para ningún grado o calificación
persona!; y que, he consultado las referencias bibliográficas que se incluyen es este
'documento.'
Pacheco Coral
CERTIFICACIÓN
Certifico que el siguiente trabajo fue realizado por Fernando Ramiro Pacheco Cora!
bajo mi supervisión.
Ing. RalWo/MorejóVi
DIRECTOR DP-RR-QYÉCTO
II!
AGRADECIMIENTO
A ios maestros que con mucho empeño y trabajo honesto compartieron sus
conocimientos y sus experiencias; y a las grandes personas que conocí
durante todo este tiempo en especial fas que llegaron a ser muy buenos
amigos.
DECLARACIÓN i
CERTIFICACIÓN i¡
AGRADECIMIENTO iii
DEDICATORIA, iv
CONTENIDO , v
RESUMEN x
PRESENTACIÓN „____ xi
CAPITULO I
CONCEPTOS GENERALES 1
1. SONIDO. 1
2. ECUALIZACIÓN ' 2
- : •
* 2.1 ECUALIZACIÓN DE SISTEMAS DE MEGAFONÍA , 2
^. 3.4.1 VENTAJAS 9
3.4.2 DESVENTAJAS 11
4. PROCESAMÍENTO DIGITAL DE SEÑALES 12
CAPITULO 2
FILTROS DIGITALES , 25
1. INTRODUCCIÓN 25
2. CLASES DE FILTROS DIGITALES 27
2.1 FILTROS FIR (FINITE IMPULSE RESPONSE) 27
2.2 FILTROS MR (INFINITE IMPULSE RESPONSE} 28
2.2.1 FILTROS AR (AUTOREGRES1VO) 28
2.2.2 FILTROS ARMA (AUTOREGRESÍVO Y MEDIA EN MOVIMIENTO), 29
2.3 OPiNfON SOBRE FILTROS HR 29
3, DESCRIPCIÓN DEL SISTEMA SOBRE EL QUE SE IMPDEMENTARAN LOS FILTROS , 30
3.1 DESCRIPCIÓN DEL SISTEMA DE ALMACENAMIENTO 31
3.2 IMPLEMENTACION DE LOS ALGORITMOS DE FILTRADO 32
4, PROCESO DE DISEÑO DE FILTROS DIGITALES , 33
4.1 TÉCNICAS DE DISEÑO DE FILTROS UR 34
4.2 TRANSFORMACIONES DEL PLANO S AL 2 34
4.2.1 ETAPAS DEL DISEÑO 35
4.3 APROXIMAXÍONES PARA EL DISEÑO DE FILTROS UR , 35
4.3.1 APROXIMACIONES DE BUTTERWORTH 35
4.3.2 FILTRO PASA-ALTO BUTTERWORTH 38
4.3.3 APROXIMACIÓN DE CHEBYSHEV í 38
4.3.4 APROXIMACIÓN DE CHEBYSHEV I! 40
4.4 MÉTODOS PARA TRANSFORMAR UNA FUNCIÓN DE S EN OTRA FUNCIÓN DE Z, , 41
4.4.1 TRANSFORMACIÓN INVARIANTE A LA RESPUESTA (TIR) 41
4.4.2 TRANSFORMADA Z PAREADA (TZR) 43
4.4.3 TRANSFORMACIÓN A TRAVÉS DE ALGORITMOS DE DIFERENCIA (TAD), 44
4.4.4 TRANSFORMACIÓN A TRAVÉS DE ALGORITMOS DE INTEGRACIÓN NUMÉRICA
(TAI) 45
4.4.5 TRANSFORMACIÓN BILÍNEAL (TBL) 46
4.5 TRANSFORMACIÓN DESDE UN PROTOTIPO DE FILTRO PASABAJOS A OTRO TIPO
DE FILTROS ^_^_________ 46
Vil
CAPITULO 3
5.3.2 SOFTWARE,_ 90
5.4 OPERACIÓN DEL TECLADO Y DISPLAY_ 91
5.4.1 PRESENTACIÓN INICIAL _ 91
5.4.2 PANTALLA DE VOLUMEN. _ 91
5.4.3 PANTALLA PARA VARIACIÓN DE PARÁMETROS _ 92
5.5 DIAGRAMA DE SUBRUTÍNA DE INTERRUPCIÓN,_ 94
5.6 DIAGRAMA DE SUBRUTÍNA DE COEFICIENTES _ 94
5.6 DIAGRAMA DE SUBRUTINA DE COEFICIENTES _ 95
CAPITULO 4
RESULTADOS Y APLICACIONES 97
1. COEFICIENTES 97
2. PROGRAMA UTILIZADO PARA EL ANÁLISIS CUANTITATIVO DEL ECUALIZADOR 99
3. ANÁLISIS CUANTITATIVO DE LOS RESULTADOS 100
3.1 SEÑAL UTILIZADA EN EL ANÁLISIS 100
3.2 FILTROS DE Q CONSTANTE 101
3.3 ANÁLISIS DE LOS FILTROS 103
4. APLICACIONES 110
CAPITULO 5
CONCLUSIONES Y RECOMENDACIONES 11
ANEXOS
ANEXO NO. 1
FUENTES DE INTERRUPCIÓN DE LOS PROCESADORES DE LA FAMILIA 2100 116
ANEXO NO. 2
ESTADO DE CONSUMO BAJO DE ENERGÍA (POWERDOWN), 119
ANEXO NO. 3
CONJUNTO DE INSTRUCCIONES 123
ANEXO NO. 4
ELADSP-2181 131
ANEXO NO. 5
FUNCIONAMIENTO AD1847 137
ANEXO NO. 6
MM74C373, MM74C374, 3-STATE Ocia! D-Type Füp-Flop 141
ANEXO NO. 7
MM74C922, MM74C923, 16-Key Encoder_ 152
ANEXO NO. 8
CALCULO DE LOS COEFICIENTES FILTROS ECUALIZADORES 162
RESUMEN
Así en los filtros I1R existe la ventaja de poder diseñar una gran variedad de
filtros selectivos en frecuencia .utilizando fórmulas preestablecidas, que
cumplirán las especificaciones mediante sustitución directa en un sistema de
ecuaciones de diseño.
XI
PRESENTACIÓN
CONCEPTOS GENERALES
1. SONIDO 1
El sonido es un fenómeno físico que estimula el sentido del oído. En los seres
humanos, esto ocurre siempre que una vibración con frecuencia comprendida
entre unos 20 Hz y 20,000 Hz llega al oído interno. Estas vibraciones llegan a!
oído interno transmitidas a través del aire, y a veces se restringe el término
"sonido" a la transmisión en este medio. Sin embargo, en la física moderna se
suele extender el termino a vibraciones simiiares en medios líquidos o sólidos.
Otra línea de trabajo, con muchos puntos de coincidencia con la anterior, pero con
importantes particularidades, se refiere a la cancelación de ecos acústicos, de
suma importancia en las aplicaciones de audio conferencia y de telefonía de
manos libres. La cancelación de ecos producidos en recepción para que no
2. ECUALIZACIÓN
Este proceso se realiza con la ayuda de filtros. Los filtros pueden ser analógicos
o digitales y permiten modificar la señal que reciben. Dejan pasar o rechazan a
través de ellos una parte específica de la señal de entrada con sus parámetros
previamente definidos dependiendo de su funcionamiento.
Cada filtro tiene un contra! de ganancia con el que se puede atenuar o amplificar
la amplitud de ¡a banda de frecuencia sobre la que actúa, es decir los
mecanismos que se utilizan para cambiar este parámetro pueden ser
potenciómetros en el caso de ¡os ecualizadores analógicos o mediante un teclado
digital en conjunto con una pantaüa de cristal liquido que es ia que presenta la
información sobre el estado de los parámetros de los filtros en el ecuaiizador
digital. Estos potenciómetros o pantallas indican de manera gráfica ía cantidad de
decibelios que se pueden atenuar o amplificar las señales. El calificativo de
3. FILTROS
Estos filtros son una dase de sistemas lineales e invariantes con el tiempo
particularmente importante. Pues un filtro selectivo en frecuencia nos sugiere un
sistema que deja pasar ciertas componentes de frecuencia y rechaza
completamente otras, pero en un contexto más amplio cualquier sistema que
modifique ciertas frecuencias con respecto a otras se denomina también filtro.
Frecuencia Frecuencia
H(f) H(f)
Frecuencia Frecuencia
Banda de
Transición
™-™^a-
o.
1— i
\L ..
Frecuencia Frecuencia
í
^.dzadg gasabanda d, pasabanda plano
i i i r
~f^
1!
E '
Frecuencia Frecuencia
1 I ~ I
e. pobre atenuación parabanda f, buena atenuación parabanda —
CQ
•a
Frecuencia Frecuencia
La Figura, 1.3 muestra tres parámetros que miden qué tan bien un filtro se
desempeña en el dominio de la frecuencia.
Los filtros digitales actúan mejor sobre una señal. Esto hace una diferencia
extrema en cuanto a! filtrado de señales, ya que con filtros analógicos eí problema
radica en las limitaciones en cuanto al manejo de los elementos electrónicos, ta!
como ia exactitud y estabilidad de las resistencias y condensadores. En
comparación, los filtros digitales son tan eficientes que frecuentemente se ignora
el rendimiento de ios mismos.
3.4.1 VENTAJAS
4 Un elemento puede producir un rango constante en Amplitud entre valores máximos y mínimos,
al que se le denomina Rango Dinámico este valor es medido en Decibelíos
10
Se los utiliza sin problemas con señales de baja frecuencia, ya que los
filtros digitales son implementados mediante tecnologías DSP, es decir por
software, no existe inconveniente en trabajar con señales de baja
frecuencia. Esto no ocurre con los filtros analógicos en los cuales se
produce inestabilidad.
Respuesta dinámica. El ancho de banda de! filtro digital está limitado por la
frecuencia de muestreo3, mientras que en los filtros analógicos con
componentes activos suelen estar restringidos por la respuesta de los
amplificadores operacionales.
5 E! muestreo consiste en evaluar la señal analógica cada ciertos valores periódicos de su variable
independiente, generalmente el tiempo. Las muestras se toman espaciadas igualmente a lo largo
de la variable independiente, eí teorema de! muestreo establece que un período de muesíreo debe
ser menor a la mitad del tiempo requerido por la señal.
11
Muy bajo costo comparándolos con los filtros analógicos, pues en estos si
se desea modificar ios parámetros de funcionamiento, para poder obtener
los resultados deseados se debe cambiar los dispositivos electrónicos que
lo conforman en consecuencia se incrementa el costo del mismo.
3.4.2 DESVENTAJAS
ir/
• Instrumentación electrónica:
a) Filtrado de señales.
^ b) Osciloscopios digitales.
c) Analizadores de espectro.
• En el espacio;
a) Fotografías espaciales
b) Compresión de datos
c) Análisis sensorial inteligente
• Electrónica de Potencia:
• Medicina:
• Control:
a) Reguladores discretos.
b) Controiadores de robots
• Comerciales:
• Procesamiento de imágenes:
a) Filtrado de imágenes.
b) Reconocimiento de Formas.
c) Compresión y descompresión de imágenes.
• Procesamiento de sonido:
• Telefonía:
• Militar;
a) Radar.
b) Sonar.
c) Comunicaciones encriptadas.
• Industria:
• Ciencia:
a) Adquisición de datos.
b) Análisis espectral
c) Simulación y modelación.
señal en tiempo continuo. Son muchas las aplicaciones que requieren esta
especificación.
La elección de estos filtros viene dada por su gran difusión actual. Se profundiza
más sobre los filtros digitales y procesamiento digital de señales en el capitulo dos
de este documento.
Los filtros digitales LTI son, por ejemplo, usuales en el procesamiento del audio.
Los equipos de música vienen dotados con filtros que le permite al oyente
modificar las cantidades relativas de energía de baja frecuencia (graves) y la
energía de alta frecuencia (agudos). Estos filtros varían sus respuestas en
frecuencias mediante la manipulación de los controles de tono.
Otra clase común de filtros LTl son aquellos en los que ía salida del filtro es una
aproximación de la derivada de su entrada.
Los DSP's son sistemas programables que nos permiten impíementar muchos
tipos de aplicaciones para los microprocesadores, en función de las posibilidades
del sistema y de las facultades del programados
17
• Direccionamiento, circular.
» Direccionamienío con bits invertidos.
Pre y post modificación de los punteros de direcciones (similar al n++, ++n, n— y
n del lenguaje C).
Fabricado con tecnología CMOS, el ADSP-2181 opera con una sola fuente de
alimentación de +5 VDC; ejecuta 33 MIPS, en el que todas las instrucciones
requieren un solo ciclo de procesador.
Desempeño de 33 MIPS.
Instrucciones multifunción.
POWER-DO WN PROGRAMMABLE
CONTROL 1/0
MEMORY FUAGS
DATA ADDRESS
GENERATORS PROGRAM
PROGRAM DATA
SEQUENCER BYTE DMA
MEMORY MEMORY
CONTROLLER
EXTERNAL
ADDRESS
ADSP-2100 BASE
ARCHiTECTURE
Tiene un temporizador, que es contador programable con 8-bit el cual provee una
generación de interrupciones periódicas y los puertos seriales proveen un
completo interfaz serial con el hardware para la compresión y expansión de datos,
Cada puerto serie podría generar un reloj interno programable o aceptar un reloj
externo, el puerto serie O incluye una opción de multicana!.
Unidad
Aritmética Datos
ji Memoria de
•^ I
Dirección Datos Datos
^•~j
9
o
a vS
O
iI ^ Instrucción
Unidad de Memoria de
OOnTTOÍ Dirección Instrucción Programa
Para las aplicaciones más exigentes los fabricantes han desarrollado una gama
de DSP's con una enorme capacidad de cálculo, de unos 1600 MÍPS, cuando lo
típico en un DSP es alcanzar unos 150 MIPS como máximo.
32-Ba A.-íkJrs
2SS-8ÍI 0¿u
Hsce.* POP.
1 ( rvv. If 3
i f^™»™..
•_-
i"
T
A •
>T3r V:ií e^-39!í :
r* -.—[
Jl ' ¿. &
1^ -;
•>
i
*
Cn¿?n CPU rcr.3 £MA hnhaf
t_
£3-. .-ür
CCftí^! 4—»
3 f3*l
LS-J-^Í^
TTT
_*. i—*| nr.,?r
í <n?ír ;
t
Este circuito incorpora en su interior una memoria SRAM de 1 Mbit (y 256 bits de
ancho) que se divide en 512 Kbits para datos y 512 Kbíts para programa/caché.
La memoria tiene una anchura de 256 bits para así poder leer 8 instrucciones de
32 bits en un soio acceso a memoria. En el caso de no disponer de suficiente
memoria interna, podemos añadir memoria externa de 32 bits de ancho; en este
caso la memoria interna de programa se configura para usarse como caché, de
modo que no disminuya en exceso e! rendimiento por usar una memoria con una
anchura de palabra menor.
CAPITULO 2
FILTROS DIGITALES
1. INTRODUCCIÓN
Los filtros digitales impiementados sobre Procesadores Digitales de Señales
(DSP's) tienen un muy alto desempeño, se pueden obtener variaciones del orden
de 100 dB en una transición de un solo hertz. Esta es una de las razones por las
que los DSP se han vuelto tan populares.
Los filtros digitales son una clase de sistemas discretos LTI utilizados para extraer
características desde el dominio de la frecuencia sobre señales muestreadas. El
diseño de los filtros se realiza de acuerdo a:
Ti
Gd(co} co
T
TU
0 >—
T
En estos casos es inmediato convertir las especificaciones de! filtro efectivo de
tiempo continuo, Gc (co) en especificaciones del filtro en tiempo discreto,
Sin embargo, los filtros digitales exhiben abrumadoras ventajas respecto a los
sistemas de tiempo continuo, una enumeración de los beneficios puede
enmarcarse dentro de la comparación entre estos dos tipos de filtros:
• Respuesta dinámica: El ancho de banda del filtro digital está limitado por
la frecuencia de muestreo, mientras que en los filtros analógicos con
componentes activos suelen estar restringidos por los amplificadores
operacionales.
Este filtro es recursivo ya que la salida depende no solo de la entrada actual sino
además de valores pasados de la salida, es decir filtros con realimentación. El
término autoregresivo tiene un sentido estadístico en que la salida y[n] tiene una
regresión hacia sus valores pasados, la respuesta al impulso es normalmente de
duración infinita, de ahí su nombre.
29
y[n] + Aly[n — I] + A2y[n — 2]+- • -+ANy\n -N] = £Qx[n] + ^ x[n - l}f- • -^BMx[n - M
-#
Entre la variedad de métodos tanto para sistemas I1R como para sistemas F1R, no
existe un tipo de fittro ni un método de diseño que sea mejor en todas las
circunstancias, es decir que la elección de! filtro depende de ías ventajas que
ofrece cada filtro para fa solución de un problema en específico.
30
Así en los filtros IIR existe la ventaja de poder diseñar una gran variedad de filtros
selectivos en frecuencia utilizando fórmulas preestablecidas, determinando el
orden de! filtro que cumplirá las especificaciones necesitadas mediante sustitución
directa en un sistema de ecuaciones de diseño. En esta simplicidad en el
procedimiento de diseño hace que se puedan diseñar filtros [IR de forma natural y
produce programas de computador no iterativos.
• Selección de los pines de entrada-salida del puerto para ser usados como
SS! y controlara! CODEC.
• Habilitación de las interrupciones del puerto SS! para que pueda darse la
comunicación serial.
'• i : Filtro: : : y
V FIR-HR;.-* D/A
*'• DSP • ;
Se usa para tal efecto un espacio de memoria RAM apuntado por uno de ocho
registros de dirección R y se define un valor, indicando el tamaño deí buffer en un
registro de módulo M. Obsérvese en la Figura 2.2 estos buffers en el DSP.
32
LIMITE SUPERIOR
PUNTERO DE BUFFER
U-MODULO
DIRECCIONES CIRCULAR
LÍMITE INFERIOR
ENTRADA AíD
11
VALORE;
ESTADOS : DEL
FiLTflO
SAUDA D/A
t Banda de
Transición
5. Aproximación de Butterworth
Por lo tanto:
\H(v)
l+e-y
T '"> '
= 101og:
e v
log
n=
Banda de
Transición
1' /-
* *X . , 'T' ""5 o -.
u- 0.5-
X' . .X
H-._ • ..-•'*.
. -* - (7 fl " cr
\ *• " "X
*' '*/*••
0 f- • •O.J- • ' ' •
X x
* .. i ':*•••'' . -X '
-! -9.5 0 !U /
De los 2 n polos de que consta H(s) H(~s) sólo estamos interesados en los polos
de la parte izquierda del piano s, que son los que dan estabilidad al filtro. De las
figuras se puede observar que cada polo tiene su conjugado, excepto en el caso
de que n sea impar donde tenemos un polo adicional en s - -/.
El polinomio Oyfs) viene en tablas para cada valor de n, por lo que solo tenemos
que determinar el valor de n, ir a las tablas para obtener Ht\{s) y desnormalizar
para determinar la H(s) de nuestro filtro.
a fi^^ =
38
V 1
2/i \2n
v
•(v)
Polinomios de Chebyshev
Tn(x)=cosh(ncosh' x)
Orden n Tn(x)
0 1
1 X
2 2X2-!
3 4¿-3x
4 8x4-8x*+l
5 26xí-20x3+5x
6 32xó~4Sx'*+18x2-l
7 64x7-112x>+56x3-7x
8 128x*-256x6+l 60x*-32x*+l
s/j = eos z
s = cosz =
Los polos estarán a la izquierda de! plano s para garantizar la estabilidad del filtro.
^A = ~sin(t
Magnitud vs. frecuencia en Hz Fase en grados vs. frecuencia en Hz
i
0.9 10fl
0.3 o
0.7 -100
0.6
0.5
0.5
Fase desenvuelta en grados vs. frecuencia en Hz
0.-Í
0.3
-100
0,2
-200
0.1
Q
Sí se desea disponer de un filtro con una fuerte transición como es el caso de futro
de Chebyshev tipo 1, pero que a la vez tenga una respuesta lo más piaña posible
en la pasabanda, se logra transfiriendo el rizado del pasabanda en el filtro de
Chebyshev i al parabanda y viceversa.
v-M/v
2 Si el periodo de muestreo es superior, T > TT/&O , la transformada de la secuencia será otra donde Xc(co) y
Xü(co) no coinciden, y por lo tanto la transformada de la secuencia no permite obtener la Transformada de la
señal continua. A este fenómeno se llama solapamiento en frecuencias o aliasing.
42
Se muestrea x(t) para obtenerx[n] y X(=) y se evalúa H(=) como Yf=)/Xf=). Este tipo
de transformación está limitada por ia frecuencia de muestreo/i* que restringe su
aplicación a aquellos sistemas cuya respuesta está limitada por +1^fs, por
problemas de aiiasing ya que la función de transferencia transformada es una
función periódica de periodo 1/ts. Esto hace que este tipo de transformación sea
más apropiada para filtros pasabajos de Butterworth y Chebyshev I que para
filtros de Chebyshev I!.
A Áz
Único
(s + p) fr-fl)
Complejo ^exp(/O) ^exp(-jO) 2z2A cos(Q) - 2Aaz cos(Cl 4- qis )
Conjugado
(s+p+jq) (s + p-jq) z2 -2azcos[q1s) + a"
Repetido A
{(s +, p)^'
¿ W _df _d ^r z -}\\
Repetido A
(y + p)2
^ (z-a)
( ^ \
tj
Repetido A i j j ^ + «)
2jl-lsi \1>
(* + P? (z-a)
Modificado A ¿z í A i z +a
(j + /?) f — a)\
(z 2
z— a
3
i \
i O3
1
2 az 1
\ s
1 Q.I \,
0
) 0.1 02 EL3 (U 0.5 % 1 2 3 -1 *
100
r-^ -—^_ ^ 100
iH-— — ..L
0
1 0
i
-100
\ -100
\
\
0.1 0-2 0.3 CM 0 .5 ) 1 2 3 4 í
Fase desnv. en grados vs. Frecuencia dígi talF Fase desnv. en grados vs. Frecuencia en fr
u u
V \
-100 \ -ICO
-
-200 --_ ,. -200
(s + a) -4
Esta transformación usa esta forma para sustituir cada término del numerador y
del denominador en una H(s) factorizada y generar el consiguiente H(z):
=K - =K• -«
44
La constante k se escoge para que las ganancias sean iguales a una frecuencia
determinada. En e! caso de haber raíces complejas, podemos hacer la siguiente
transformación :
/-> —pr.
•z -2~ze y - eos (qts)+ e
r i -v[/i + •l]-.r(/?-l] ^
Z^ — ii
Central 1/1 JH —
>L"J - - ii ' / '
2ís 2zis
— 1
Hacia Adelante -f-i-^ + l]-*!"]
y\.nl-
*s í^
Aquí tenemos bastantes más algoritmos para hacer una integración numérica, ia
Tabla muestra algunos algoritmos típicos:
Adams(3) .r i- .r {9,T[n]+19A-[n-l]-5.x[7i-2]+A-[^-3]X-
>L n J >L" J 24
Simpsom(2)
ri r oí {^W+^vCn-il+a-fn-z]}^
' 3
Tlck(2) >{n] =>{/i-2] + {0.35S4x[«] + L2832,T[n-l] + 0.3584.r[/i -2]}^
Transformación $-±t
Algoritmo Transformación
1 z-1
Rectangular (1)
T 2
2 z-1
Trapezoidal (J) í,z + l
12 z~ — z
Adams (2)
í " — t
24 2- 3 -^ 2
Adams (3)
'' /, 9z 3 +19z 2 -5z-í-l
3 -" ~~ 1
Simpsort (2)
3 z —1
Tick(2)
í_ Ü^í054z^ +-L2o-)2z-fi AU.j>3o4
j: A^'í'O-l—^ , l O O ^ O ^-CO-l
Excepto los algoritmos de Simpson y Tick, el resto producen H(z) estables a partir
de un H(s) estable para cualquier valor de ts.
2 + sí 2 z-1
z — > -— =^> s —? —• -
2~¿>^ t 2+1
1-yfi)
Esta expresión nos dice que un punto del eje imaginario de s, se transforma en un
punto en el círculo unidad en el plano z.
_ .. ,
Generahzando, para s=
'*
lo que implica que un punto de la mitad del piano s donde a < O, se transforma en
un punto dentro del círculo unidad en el plano z. Por ¡o tanto, un diseño estable
en s, será también estable en z bajo la transformación biiineal, además no hay
afiasing, ya que a cada frecuencia analógica le corresponde una única frecuencia
dígita!.
Utilizaremos este método para realizar el diseño de filtros IIR tipo pasa-altos,
pasabanda y rechazabanda, así primero diseñaremos un filtro pasabajos con los
parámetros y especificaciones que se necesiten y luego realizaremos los cambios
47
necesarios para tener los filtros deseados, utilizando los criterios tabulados a
continuación:
Salidas : [N Wn]
PasoBajo ^ a , As=as
Paso Alto "Wp=wp, Ws= , As=as ->
PasaBanda Wp=[wpl wp2]., Ws=[ws] =ap, As=as -
wp2, Bw=wp2-\vpl
ParaBanda 2], Ws=[wsl ws21 Ap=ap, As=as -* (BlíAll=3p2bs(BíA,wxrB\v),
•)
wx~=wpl-wp2, Bw=wp2-wpl
Tabla 2.9 Utilización de ¡a función para calcular el orden de ios filtros
MR (Butterworth, Chebyshev I y II)
49
CAPITULO 3
1. INTRODUCCIÓN.
Las ventajas diseño con filtros de Q Constante van más allá que el rendimiento
con respecto a ios datos de control de parámetros, aunque estos proporcionan un
grado de ajuste imposible de obtener con otro tipo de ecuaiizadores como los
analógicos. Los refinamientos cruciales de respuesta de frecuencia que se tienen
con este tipo de ecualizadores permiten una altísima claridad y reproducción
legítima.
50
Las secciones de los filtros son totalmente aisladas de los efectos de la amplitud y
la banda de transición de los filtros, así como de la frecuencia central y el ancho
de banda, permitiendo diseñar cada filtro para la frecuencia central precisa y el
ancho de banda estrecho que es requerido.
Por lo tanto estos ecualizadores tienen un rendimiento mucho más alto y una
respuesta de frecuencia notable como se muestra en la Figura 3.2.
90
•'o
CO
9.C
6.C
3.0
0.0
Por otro lado la cuo/a resultante producida por un ecualizador es una combinación
de las magnitudes de los filtros individuales que son fijados por los mandos del
ecualizador, la curva de rendimiento será entonces la combinación, sin tener en
cuenta la filosofía del diseño del ecualizador.
Como estos efectos son un resultado directo del ancho de banda del filtro,
cualquier ecualizador que tiene filtros con el ancho de banda variable no se le
puede predecir su respuesta.
53
Hay dos formas de realizar filtros digitales: por software y por hardware.
En los dos casos deberemos hacer un diagrama con las operaciones a realizar,
en software se habla de un diagrama de flujo, mientras que en hardware es un
diagrama de bloques, que especifica los elementos del circuito y sus
interconexiones.
rr r.\(Z)
l+G(z)H(z)
Elemento Sumador
1
l-Kiz~l4—
_-//
- N] - M]
y[n]
—I
i=intl
N+Y
/=J
L L
r ( \
f (z) = P
=0 ^ +OÍ1;.Z 4-1
lo que da lugar a las formas en cascada, Cascada II y Cascada Transpuesta
Figura 3. 12:
61
Los efectos de cuantización deben ser tenidos muy en cuenta cuando el diseño se
realiza en microprocesadores con aritmética de punto fijo (por ejemplo, DSPs).
En caso de utilizar micros de 32 bits con aritmética en punto flotante, los efectos
de cuantización pueden ser despreciados.
62
3, EFECTOS DE CUANTIZACJON,
1 Í
El error es cero si todos los bits rechazados son cero, y será máximo si todos los
bits rechazados son 1 . Eí error máximo es por tanto:
1=64-1
-2 h<£ <0
El análisis se hace sumando una señaí de ruido a ia señal sin truncar. Esa señal
de error tiene la media y varianzas calculadas previamente.
r^s. v ín ] \ f"\ ín 1 -
tí[nj _J ->__-__*J O \—+V[n] V[R]
i—-1
01011+ 01101- 11000 Eliminamos ei bit de signo porque hay overfiow 01000.
Una forma de evitar el overflow, es multiplicar las operaciones por un factor que
evite ei overflow, este factor debe ser lógicamente menor que 1, ío que empeora
la relación señal ruido del filtro.
x[nj ~
Sin perder generalidad utilizamos una representación digital de 5 bits con signo y
haremos redondeo en !as operaciones en vez de truncamiento.
Para los dos valores de a se observa que cuando a>0 , la salida tiende a un valor
constante distinto de cero, mientras que si a<0 , la salida oscila entre dos valores.
Esto se debe a que el sistema tiene un polo efectivo en ei círculo unidad, en este
caso el sistema tiene un polo en z=? para a>0, y en z=-1 para a<0; esto implica:
y
s
Con esta fórmula tenemos delimitado ei rango de variación de los ciclos límite, por
tanto ai utilizar un mayor número de bits de cuantización disminuye la amplitud del
ciclo límite, esto no es siempre posible, por lo que existen técnicas de eliminación
de ios ciclos límites basadas en realizaciones en espacio de estado.
Una función de transferencia Hfc)** 1 / (1+aj • fl +a2 • r2) , cuyos polos complejos
son p y p* cumpliéndose que a¡ ••= -2- Re(p) y a2 =j p\ ,
Por tanto, cuantizar e? significa cuantízar la parte real del poío, mientras que
cuantizar a 2 significa cuantizar e! radio del poío. Esto se muestra en ía Figura
3.16:
o
Re(z)
• "En la vecindad de z=-±1t los posibles polos están más separados entre sí.
Se dice que estos polos son muy sensibles a la cuantlzacion.
Los coeficientes en estas forman no nos dicen nada acerca de ia situación de sus
polos y mucho menos acerca de las consecuencias de su cuantizacíón, entonces
ía solución es, lógicamente, utilizar las formas Paralelo o Cascada para tener un
mayor control sobre la situación de los polos al cuantizar.
H hecho de que los ceros en un filtro digital estén sobre el círculo unidad, hace
que ios coeficientes del numerador sean *? ó -1, por ío que en ias formas en
cascada se pueden ahorrar desde un 25% a un 50% en multiplicaciones
comparado con un diseño en paralelo.
-4 O
Los ceros en un "filtro 1IR son más problemáticos, pues aquí no tenemos la
seguridad de que los coeficientes son simétricos, por lo que habrá que tener ias
.mismas consideraciones que las explicadas en el caso de los polos, además hay
que tener en cuenta ei caso habitual en. que varios ceros estén en z=±1, por lo
que su cuaatizacióa no tendría efectos gravas.
Dado ei futro digital liR con Fs=25 KHz, cuyos coeficientes S y A son. tratados
primero sin tratamiento y luego con redondeo a 3 bits
• 1 ) ) I 1
1
r
\
<u <
3.6
«• 1 J _ _
0.2
l>
0
'•\ f.
J.2
Respuesis del frUío cttaíiiízaaio a 3 ¿i-gtío-s d-cí-ísaales
0.34
' '•.
;- '
¡*
0.4 , •<
i * ^
íi
2000 4000 J JUÜO
F r e c u e n c i a (Hz)
Fabricado a alta velocidad, metal doble, baja potencia, proceso CMOS, que hace
que el ADSP-2181 opere con un tiempo de ciclo de instrucción de 30 ns. Cada
instrucción se ejecuta en un solo ciclo del procesador.
Los dispositivos en este procesador son de 16 bits, y ésta es una máquina con
punto fijo, y la mayoría de operaciones se asumen con una representación de
complemento de dos, mientras otras operaciones se asumen como números sin
signo o simpies cadenas binarias.
0x0001 0.000031
Ox7FFF 0.999969
OxFFFF -0.000031
0x8000 -1.000000
Todas las operaciones sobre la ALU dan como resultado una simple cadena de
16 bits, excepto la división con signo primitiva (llamada DiVS), aunque existen
varias operaciones que dan resultados con signo como la condición de overflow
(AV), y la bandera negativa (AN).
El multiplicador produce resultados que son cadenas binarias. Las entradas son
"interpretadas" según la información dada por la propia instrucción (números con
signo con números con signo, números sin con números con signo, mezclados, o
una operación del redondeo). El resultado de 32 bits del multiplicador es con
signo, con este signo extendido se llena de 40 bits el registro MR.
X Y
r
f
3V
1r
I
A^r A'
-r ,—i
í
TMU* *
1F
ib
<ÍEG:Srí:íí
1 r
COVPARs
,
L
-(
\ r
MwX vux
i JLJ ,A
*
]:
R=O:5'£R
NcGriTE
i, . •
/*
í i
L^
rigura 3.23 Diagrama de Bloques deí SH1FTER
El arreglo del shifter está formado por un desplazador de barril de 16x32. Este
acepta una entrada de 16 bits y la puede colocar en cualquier del campo de salida
de 32 bits, en un solo ciclo de máquina. Esto da lugar a 49 posibles posiciones
dentro del campo de 32 bits. La ubicación de las entradas de 16 bits está
determinada por un código de control (C) y una señal de referencia (Hl/LO).
SKTRí/CCíOíf
£OLAM9rfEDAG1
DHÍECCIOII
4.1.5 SECÜENCÍABORDEPROGBAiVtA
SPORT* Troiweateüu
SPORT» Rec«pj;
SPORTí
SPORTí» Hecí-[»':I»Jn o
TlMSt
Los ADC y DAC operan a una taza fija de muestreo de 8 kHz y sus componentes;
un chip con filtros anti-aliasing y anti-imaging, conversores de sigma-delta de 16
bits, y los amplificadores de ganancia programabíes aseguran una solución
favorablemente integrada para cumplir los procesos en la banda audible. La
tecnología de conversión de sigma-delta elimina la necesidad de chips complejos
para anti-aíiasing y gran circuitería para e! muestreo.
AMALOG1 1 Uí4Tl-A.
SíGWA-S£ÍTA. \ „- | agCg
MÜOULATOR I \ F1LTER
f í.í) |
4.2.3 ABC
4.2 5 DAC
Los números de los pines sobre estos conectores son arreglados como indica la
Figura 3.27 y serán utilizados para la conexión de hardware adicional, el teclado y
el display.
84
2 50
OOo o **« o
nooo o
1 49
P2
NOMBRE I P2 NOMBRE
NUMERO DE
DE LA SEÑAL j NUMERO DE PÍN DE LA SEÑAL
PIN i
1 AO 2 A1
3 A2 4 A3
5 A4 6 A5
7 A6 8 A7
9 A8 10 A9
11 A10 12 A11
13 A12 14 A13
15 DO 16 D1
17 D2 18 D3
19 D4 20 D5
21 D6 22 D7
23 D8 24 D9
25 D10 26 D11
27 D12 28 D13
29 DI 4 30 D15
31 D16 32 D17
33 018 34 019
35 D20 36 D21
37 D22 38 023
39 WR 40 RD
41 ¡OMS 42 BMS
43 DMS 44 CMS !
45 PMS 46 BR
47 BGH 48 BG
49 VCC 50 GND
1 GNO- 2- JADO
3 IAD1 A ÍAD2
5 4AD3 •6 -!AO4
7 1AD5 ' 8 1AD6
9 1AO7 10 1AÜ8
11 IAD9 12 IAD10
13 IAD11 14 IAD12
15 1AD13 16 1AD14
17 1AD15 18 GND
19 lACK 20 IAL
21 IS 22 IWR
23 !RD 24 GND
25 PFO 26 PF1
27 PF2 28 PF3
29 PF4 30 PF5
31 PF6 32 PF7
33 FLO • 34 FL1
35 FIJ2 36 CLKOUT
37 RESET 38 IRQ LO
39 1RGL1 40 ]RQ2
41 PWD 42 PWDACK
43 CODECDJS 44 TXDO
45 TFSO 46 RFSO
47 RXDO 48 SCKO
49 VCC 50 GND
5. DISEÑO
Para implementar el ecualizador digital tenemos primero el diagrama de flujo para
la configuración de la tarjeta ADSP-2181 para que la tarjeta cumpla con las
especificaciones deseadas y cumpla con los requerimientos necesarios para la
entrada de datos por teclado, salida de datos por una pantalla de cristal liquido y
ia codificación de la señal analógica sea óptima.
5.1 DIAGRAMA DE FLUJO DEL PROGRAMA PRINCIPAL
JNJCÍO
CONFIGURACIÓN DISPLAY
Configura la subrutina para presentación de datos
y presenta ía pantalla inicia!
T
CAMBIO COEFICIENTES
La memoria donde se guardan Sos coeficientes
para ios filtros ecuaífzacíores se afmacenan cony
coeficientes para una señai plana
MODO IDLE
Espera de interrupción
na
con bajo consumo cíe
potencia
SUBRUTÍNA DE INTERRUPCIÓN
5.2 TECLADO
Para un perfecto control sobre los parámetros que deben ser variados por el
usuario y utilizados por el procesador para subrutinas como aumento o
disminución del volumen de la seña!, cálculo de los coeficientes de los filtros
ecualizadores, control de ganancia, frecuencia central, o simplemente para la
presentación del proyecto se ha acoplado a la tarjeta un teclado como hardware
adicional para el efecto.
Fe G +
ffi
Tecla primera fila, segunda columna; sirve para poner en silencio total el
ecualizador, con la primera presión, y vuelve a su estado normal si se
vuelve a presionar.
^ Tecla segunda fila, tercera columna; sirve para la selección del filtro
ecuaüzador escogiendo la frecuencia central del filtro y disminuyendo la
secuencia de estos hasta iiegar al menor y empezar de nuevo el ciclo de
elección.
Este teclado utiliza un codificador para 16 teclas con salidas de tres estados
compatibles con TTL el MMT4C922 y este integrado provee toda la lógica
necesaria para una total codificación dei teclado.
La búsqueda o "sean" del teclado puede ser implementada por un reloj externo o
un capacitor extemo y no necesita utilizar diodos para eliminar los efectos por
rebotes. Un pequeño registro interior en el circuito interno recuerda la última
tecla.
D.IT.'i AV ,111 A g i r
IOC
W'¿ICO??
r
"
v*
JÍ4 KS/-1
r " CJ11
r./
XI
f ro DATA sus
1
. , p.
•) f ,
D SC ¡ ÜE
c
~T~
JL °\K
0^1—
• Compacto y ligero.
Por causa dei microcontrolador de! LCD que trabaja a una velocidad mínima
muchísimo mayor al tiempo máximo especificado para ta tarjeta ADSP se trabaja
con un circuito integrado CMOS flip-flop tipo D para compensar eí problema pues
ambas señales de control pasan a través del CMOS octa! flip-flop tipoD lo que
hace que ellos puedan mantenerse tanto como sea necesario.
DO:
D3
R3
E
--Q R/ A1
DSP LCD
5.3.2 SOFTWARE
Cada LCD tiene una secuencia de inicialización que debe realizarse previamente,
esto configura el modo de despliegue y ancho de datos (4 o 8 bits).
91
Con este circuito se tiene el ¡nterfaz necesario para conectar una matriz de hasta
16 teclas al sistema digital de la tarjeta ADSP y realizar una tarea en específico
porcada tecla.
Utiliza las teclas ^ y ^ para variar la frecuencia central del filtro y seleccionar
el filtro que puede ser tratado, pero no hace ningún cambio en el procesamiento
de las señales.
Banda 1 2 3 4 5 6 7 8 9 10
Frec. Central [HzJ 120 200 400 800 1.5K 3K 6K 12K 14K 16K
TIPO DE
INTERRUPCIÓN
ENTRA DE Fe Y
G POR TECLADO
SUBRUTINADE
COEFICIENTES
ACTUALIZACIÓN
DE REGISTROS
FIN
INICIO
ACTUALIZO
Valor de Fe Y G
T
DETERMINO
Los coeficientes de
¡os filtros
LEO
A1, A2, BO,B1,B2
de la memoria de
datos
I
ACTUALIZO
Registro de Coeficiente,
de ia memoria de
programa
1r
FIN
INICIO
TOMO
Señal de! canal
derecho e izquierdo
deí CODEC
ALMACENO
Las señales en ¡os
bufe res
LEO
Los coeficientes de
ios filtros
FILTRO
las señales y
almaceno en ¡os
buffers
ESCRIBO
la señal filtrada totalmente en
el buffer de transmisión del
CODEC
FIN
CAPITULO 4
RESULTADOS Y APLICACIONES
1. COEFICIENTES
Así que se creo una pequeña base de datos en la memoria de datos de la tarjeta
donde se encuentran localizados todos los coeficientes con los que trabajan los
filtros, y una pequeña subrutina que encuentra y ubica estos coeficientes en la
memoria de programa, de donde son tornados por el microprocesador para el
procesamiento de las señales.
^|í
Para realizar el análisis se tuvo que modificar el programa de filtraje y para poder
obtener la función de transferencia real, se proceso solamente la señal del canal
derecho y se dejó pasar la señal del canal izquierdo sin modificaciones.
99
Para poder realizar un análisis comparativo entre los cálculos teóricos y los
resultados reales el uso de un analizador de espectros es indispensable, y para e!
efecto se utilizó un programa llamado SpectraPRO que convierte a la tarjeta de
sonido en un analizador de espectro en todo el rango del espectro audible
mediante la transformada rápida de Fourier (FFT).
Este programa que se permite utilizar so!o por treinta días, es muy especializado
para el análisis en frecuencia de todo tipo de seña! de audio y sus prestaciones
son excelentes, así tenemos que se puede hacer e! análisis independientemente
de cada canal en e! dominio de la frecuencia y del tiempo, el anáüs-is puede ser en
dos dimensiones y hasta en tres dimensiones, ia presentación puede ser en
líneas o en barras y se pueden realizar cálculos muy complejos como ia función
de transferencia entre e! canal derecho e izquierdo, función que para ei análisis
de la respuesta en frecuencia del dispositivo implementado es muy útil con la
ayuda de un generador de frecuencias.
101
20
HdBk.¡
-20 -
,4.7952-10 ,
Si comparamos la Figura 4.4 con la Figura 4.5 podemos darnos cuenta que la
amplitud, el ancho de banda, y la frecuencia central son exactamente a ios
propuestos en el diseño.
103
Comprobamos con esta comparación que !os cuatro filtros aunque tienen
ganancias diferentes tienen el mismo factor Q, que es una de las principales
características en el diseño de estos filtros ecualizadores.
Para realizar el estudio del funcionamiento del ecualizador digitaí gráfico se han
tomado como ejemplo los casos extremos; filtros con ganancia de +20dB y ~20dB.
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Comparando las figuras desde la 4.6 a la 4.15 con las figuras 4.16 y 4.17 tenemos
que los filtros del ecualizador son iguales a los filtros simulados con MATHCAD y
cumplen con todas las especificaciones de diseño, aunque con pequeñísimas
variaciones imperceptibles en el oído humano.
70
HdB k,¡ 40
HT;
-10
-20
-30
HT.
-40
-50
-60
-70 -
r/e /vnplrtudé
*"
o
O
\0 O
i fr
••-i"'-.;'- .>200k
3.4 CARACTERÍSTICAS
Se puede observar en la figura 4.18 que las altas frecuencias tienen un mayor
nivel de señal después de ser procesadas y se debe a ¡as características de
diseño del ecuaíizador. La ganancia de los filtros son variables y su Q constante,
y con los ejemplos de los casos extremos ya se puede tener una idea de los
resultados que se pueden tener a! variar al azar las ganancias de los filtros, un
ejemplo en la Figura 4.20
algo de sonidos agudos y obtener así un buen matiz y una sensación agradable
en el oído.
H d B k.i
HT.
0.5
4. APLICACIONES
Normalmente se utiliza las ganancias de los filtros entre los +12 dB y los -12dB y
así es como están diseñados los ecualizadores comerciales, pero con este
ecualizador en particular se pueden realizar ecualizaciones especiales para
anular o enfatizar mucho ciertas frecuencias para resolver situaciones poco
comunes o muy exigentes como reproducir grabaciones antiguas en mal estado,
grabar en salas de con mala acústica, sistemas karaoke, etc.
111
CAPITULO 5
CONCLUSIONES Y RECOMENDACIONES
En los filtros [IR utilizados existe la ventaja de poder diseñar una gran
variedad de filtros selectivos en frecuencia utilizando fórmulas
preestablecidas, determinando ei orden del filtro que cumplirá las
especificaciones necesitadas mediante sustitución directa en un
sistema de ecuaciones de diseño.
ANEXO No. 2
XTAOTIS
ü!-q f O-ACI<IC*I«
J
iXTAL pin
r~-> íxlv
* PUCR=1: borra el PC, las pilas de ESTADO, LAZO y CNTR. Los registros
IMASK y ASTAT se ponen a O y SSTAT se pone a 0x55. Ei procesador iniciará
ejecutando instrucciones desde ia dirección 0x0000.
Ingreso ai Powerdown.
Pin PWDACK.
El pin de reconocimiento de! powerdown (PWDACK) es una salida que indica
cuando el procesador está en powerdown. Este pin es conducido a alto por el
procesador cuando este se encuentra en powerdown y es conducido a bajo
cuando el procesador ha completado su sucesión de encendido. Un nivel bajo
en el pin PWDACK también indica que existe una señal CLKOUT válida y la
ejecución de la instrucción ha empezado. La figura muestra un ejemplo de
tiempo para el powerdown y la sucesión de reinicio.
El procesador está ejecutando código cuando el pin PWD se lleva a bajo. Los
vectores del procesador e! vector de interrupción del powerdown y una
instrucción IDLE es ejecutada causa al procesador entrar en potencia baja
(powerdown). Las señales CLKOUT y PWDACK son conducidas a alto por e!
procesador. En este punto el pin del reloj de entrada se ignora.
CLKIN ---JWÜ1ÍU
PWD
PWDACK
Jüuuiniuuuinj——
PWRDWM PCWERED - » I « S7ART CLK
— "uuiru
PEHD1HG DOWM '
EXECUTS IOLE FWISH ¡OLE
ANEXO No. 3
CONJUNTO DE INSTRUCCIONES
Instrucciones de la ALU.
AK
AF
MíJJ -f- C
- xnp -r- a
\ T rti
AND
OR
XOR
AR nOF .\op
AF 3ETBÍT n OF \tip
TGIJBtrii
cor.tUíum; VAS$
[If t í H
AF
AR Nüí
AF yup
AR A8S
AF
AR
A?
AR Yllp
AP
UiVS vuu,
DlVQ'xop;
124
.x,,p A.Vi_.\Xí
t *%s .¡.t:. / . ' I . )
'..: -..ili.t ';-.IM / í , r¡t--í / " t - MU;» Mil:. M-ti;
1 ..-.i í - i . i i :•'.['-(: /-"i '.
í - ; . .:!, ; i •:? y. Í H
M,......
NO í' Aí- N..I • \ M . ' i . í | f V W
V, Al i. . v . - : Ü :',v Ar;
NOí -U N-! M í.:....!-iUt^v
V*V ' :'!'. S pt.-.'li.i ::.<• üTuil --I •.-),-. T . t j i t ; - - \ ^ . -;ii:--> V1
NO? MV N.ft MAC .^«lím*
Ni'. • V |< ,:t..-ii' •-•;..;( I.t:;í..jl('. '
X.
Instrucciones de la ALU.
¿SÍ- ( . ( Ü K Í i l U U l j ;. M R j í RND}},
[f ? N Í V S A 1 M K ;
M \ufi MVi M\
i.I MSíi MKÍ MK2
'. I
Sí-:-,. *\!
t-xip MY;\
Mr-
\.-j \ t ---líH
MV NíAí- UVí-illM'.S
N O V l t A l - ¡N- HÍJÍn-0
'O:¡íyfuíH:Ml\ Aí^
f
126
¡U
líi
i.O
•V.
NÍJÍ AV
MV
N w l MV
instrucciones de desplazamiento.
127
Instrucciones de Movimiento
Residuos:
Registros de ihilos: drcj*
m; :
DM {<rl«Mn=*>) ;
D\ iü MU í.
11 r MI
!11 , M2
J.7 ' M3
1-í M4
15 , M5
líi , M6
17 ' M?
DM í ÍÜ MU t ^ CÍlVg
U t MI <íirll»Í>
Í2 hl'2.
ÍO ;\
-
M . M-i
ííi MÍ
¡7
, M7
DM
PM í i-t , M4
15 r M5
!? ' Mr
Í'.M M Mí ) - arvj
í^ M?
iíi Mñ
17 M"
Instrucciones de Movimiento
128
Instrucciones Multifuncíón.
MU'
\i
u»
11 \
1.! M:
1..' M:-
II \Í4
TÍ M:-
1i"1'.
\ir
14 VA
I* M ;-
Ir"» , Mó
17 M7
!ü
II
\íí
M5
Mí*
Instrucciones Misceláneas,
Instrucciones misceláneas.
131
ANEXO No. 4
El ADSP-2181
Arquitectura de la memoria.
ADSP-2181
Oi
•-P/íUL
k» CLKlí
AJJ1Í1Í-3
^
L 1
BYIti
A[ O./
-N _^ ' '' ' W. A VtMO».Y
m'¡7
IRI ir
p,n •V- .
ir-oi 1
Y.'n ADJP
SPOWM —
* »
^==C
D=VIC£ r-'si cniri"* -
OH C'i fO
D'í1 Üíí fí
_ „
SPOfí'/tí AÜJR OVLRLAY
SCLK1 OArrt MEMORY
UVC ¿K
Übv'lCfc
DTC *
*\ [>LÍC cu*;
iíMí! nvo ÍK
/O/HA POS r J> 'L'1
r^
mií-
rlVD
.CCtíTROU-tP
*>-*
Memoria de Programa.
El ADSP-2181 tiene 16K de 24 bits de memoria RAM de programa y la
capacidad de acceder hasta 8K de palabras de 24bits, en espacios de memoria
externa utilizando el bus de datos externo. La tabla muestra la organización de
memoria
Memoria de programa Dirección
SK internos (PMOVLAY = O, MMAP = 0} 0x3 FFF
o
SK externos (PMOVLAY = 1, MMAP - O o MMAP = 0) 0x2000
OxlFFF
SK internos
0x0000
Organización de la memoria de programa
132
Memoria de Datos.
La memoria de datos de 16 bits, almacena datos y Sos registros de controí
mapeados en memoria. ADSP-2131 tiene 16K de memoria de datos RAM,
consistentes de 16532 localidades par datos y 32 registros de control
rnapeados en memoria. Todos los accesos de memoria interna de datos son
completados en un solo cicio de procesador.
Memoria de datos Dirección
OxSFFF
32 registros de control mapeados en memoria
OxSFEO
OxSFDF
SI60 palabras internas
0x2000
SK interna (DiMOVLAY = 0) Oxl FFF
o
Sk externa fDMOVLAY = 1 o 2) 0x0000
Configuración de ia memoria de datos
E! controlador BDMA.
El controlador BDMA permite cargar y grabar instrucciones de programa y de
datos, utilizando el espacio de memoria byte. E! circuito BDMA también está
disponible mientras el ADSP:2181 está en funcionamiento normal, el
controlador BDMA lee o escribe código de programa o datos desde o hacia la
memoria byte "robando" solamente un ciclo cuando es necesario escribir o leer
i:
0 - ¡oíd ^-oni SY
' = s;ore to BM
2pq
MEVORV O-fundit'ingEDM
WOPD -tefrduing 9D?íI
E SPACE SIZE AL1GNMEM
datos en el chip, sin importar el valor dei pin MMAP, ni de ios registros
MOVLAY o DMOVLAY.
Puerto IDMA.
El puerto IDMA proporciona un medio eficiente de comunicación entre un
sistema Host y el ADSP-2181. El puerto se utiliza para acceder a la memoria
de programa y la memoria de datos en el chip con solamente un ciclo de
sobrecarga para el procesador.
El puerto IDMA no requiere ninguna intervención del ADSP-2181 para
mantener el fiujo de datos, es completamente asincrónico y puede ser escrito
mientras el procesador está operando a toda velocidad.
15 li 13 12 tt 10 O 3 T
•DWAD
DíiSünatioi Mvíiio'y íyso:
0-Ptf. 1-DM
La interfaz del BDMA se setea durante el reset a los siguientes valores por
defecto: los registros BDIR, BMPAGE, BIAD, BEAD son puestos en O, el
registro BTYPE se setea a O para especificar palabras de memoria de
programa de 24 bits, y el registro BWCOUNT se carga con 32, Esto ocasiona
que las 32 primeras palabras de la memoria de programa en el procesador
sean almacenadas desde la memoria byte. Estas 32 palabras son utilizadas
para configurar al puerto BDMA de tal manera que se pueda cargar el código
de programa restante. El bit BCR es puesto a uno, lo que ocasiona que la
ejecución del programa se detenga hasta que se almacenan las 32 palabras en
la memoria de programa interna del procesador, luego la ejecución del
programa empieza en la dirección cero. Si BMODE = O y MMAP = O, después
de un reset el ADSP-2181 puede almacenar código de programa por medio de
su puerto I DMA. Por este puerto se puede almacenar la cantidad de memoria
necesaria para la ejecución de un programa en el procesador. La ejecución del
programa es detenida hasta que escriba la localidad O de la memoria de
programa en el procesador.
137
ANEXO No. 5
Las entradas L1NE1, LINE2, AUX1 y la señal estéreo de salida post - mezclada
del DAC; Son multiplexadas hacia la etapa amplificadora de ganancia
programable (PGA). Esta etapa permite seleccionar la ganancia independíente
de cada canal, desde O hasta 22,5 dB en pasos de +1.5 dB. La salida del PGA
se lleva hacia los ADCs, que proporcionan datos PCM de 16 bits, que se
pueden comprimir a 8 bits utilizando los estándares de telecomunicaciones A-
law (Europa) y u-law (USA, Japón). Los datos digitalmente codificados son
llevados hacia el puerto serial del CODEC. La figura muestra el diagrama de
bloque del AD1847.
ALIMENTACIÓN
RELOJ CRiSTALSS
I/O ANALÓGICA DIGITAL SALIDA I/O
ANALÓGICA- DIGITAL
RfcSfcT
DOWN
J 1. \O — EUS
GAIH TCOHVEKTIDOR
PRINCIPAL
L \D - TIMfcSLOí
GAIM ¡NPUT
-te- TIME SLOT
OUTPUT
'SERIAL DATA
ourpur
-SERIAL DATA
ATTEM' 1. \A IfiPUT
MU re COWVEFCT1DOR -te- CONTROL
EXTERNO
ATT&rí-' 1 \A
MU TE CC^MVERTTOOR -te- SERIAL BIT
RELOJ
Hte-TRAHA
AUX 2
SYNC
IMPUT
. AD1647
El AD1847 opera con dos cristales externos XTAL1 y XTAL2. Como mínimo se
debe utilizar XTAL1, y si no se utiliza ia entrada XTAL2; debe ser
cortocircuitada a tierra. Las frecuencias recomendadas del crista! son 16.9344
MHz y 24.576 MHz.
Interfaz Serial
Las salidas de los ADCs (canal izquierdo y derecho) están disponibles en la
interfaz serial, el cual también proporciona entradas digitales para los DACs y
la información de control. La interfaz serial utiliza un esquema TDM. La tabla
resume la descripción de los pines de ia interfaz serial del AD1847.
139
NOMBRE
E/S DESCRIPCIÓN
DEL PIN
SCLK
Señal bidireccíonal. Es una salida hacia el bus serial cuando el pin Bus Master
(Reloj Seria!) E/S
(BM) está en 1 lógico y como una entrada cuando el pin BM está en O lógico.
SDFS
Señal bidireccíonaí. Proporciona la señal de sincronización de trama hacia el
(Sincronización
E/S bus serial cuando eí pin Bus Master (BM) está en 1 lógico y recepta ías señales
de Trama de
de sincronización de trama como cuando el pin BM está en O lógico.
Datos Seriales)
SDl Es utilizado por los periféricos para proporcionar la información de control y
(Entrada de datos hacia el CODEC. Todas las transferencias por este pin son de 16 bits
Datos Seriales) empezando por el MSB.
SDO
SDO proporciona la información de estado y lectura indexada a los periféricos y
(Salida de
los datos capturados.
Datos Seriales)
RESET Se activa en bajo e inicializa Jos registros del XD1S47 a sus valores de defecto.
Se activa en bajo e inicializa los registros de control en el CODEC y ío deja en
PWRDOWN
un modo de consumo de baja potencia.
BM = 1; el AD1S47 proporciona las señales de reloj (SCLK) y de
BM sincronización de trama para e! bus serial.
(Bus Master) E
BM = O (para sistemas que utilizan varios CODECs); el AD1S47 recibe las
señales de reloj y de sincronización de traína.
TSO
El AD1847 mantiene esta señal en alto coincidentemente con el LSB del último
(Salida de ías
slot de tiempo utilizado por el CODEC. Esta señal se usa en sistemas que
ranuras de
utilizan varios CODECs.
tiempo)
TSSEL=1; indica al AD1S4/ que debe utilizar inmediatamente los siguientes
tres slots de tiempo.
Tsr
TSSEL=0; el ADIS47 debe utilizar los siguientes seis s!oís de tiempo. TSI debe
("Entrada de las
ser puesto en O lógico si el AD1S47 es el bus master o si está utilizando un solo
ranuras de
CODEC.
tiempo)
Registros De Control
E! AD1847 tiene: 6 registros de 16 bits y 13 registros de 8 bits (Registros
índexados).
Auto - calibración
Eí AD1847 puede calibrar los ADCs y DACs, este proceso toma por io menos
unos 384 períodos de muestreo. Se reaiiza una auto calibración cuando el
CODEC termina ía Habilitación deí Modo de Cambio y eí bit ACAL deí Registro
de Configuración de la Interfaz es uno lógico. El bit ACi en la Palabra de
Estado permanecerá en 1 lógico mientras la autocaübración esté en progreso y
se pondrá en cero una vez que la autocaübración se complete.
142
co Connection Dtagrams
O Pin Asstgnments for DfP and SOK;
MM74C373
íT>
O
Truth Jabíes
MM74C373 MM74C374
DIsabJe ENABLE
L H H H L H H
-^
L H L L L L L
L L X Q L L X Q
H X X HI-Z L H X Q
H X X HI-Z
B!ock Díagrams
MM74C373 (1
o
MM74C374 (1 o
MM74C373 • MM74C374
AbSOÍUte MaXJmUíTi RatmgSíNoíe 1J Operating Vcc Range 2Vto15V
Absolule Máximum Vcc 1 8V
tolíage at Any Pfn -0.3V ta Vcc + 0.3V ™
Lead Temperatura (TL)
Gperaíing Temperatura Ranga (TA) ,.. ,, . ír> ,% oe™,-
^ ^-v^r («otdenng, tG seconds) 260°C
MM74C373 ~4Q3C lo -f85=C
Storage
a
Temperatura
r
Range
° *(T='
s) -S5'C lo -H50°C u
Hat» ,1: .Afasoirne
„ _ . Max-imum
„ . -,„_.
Rabngs. are EÍÍCS«
_ fc
vníues ».b-j-sutí
„_, -«ti<n
^- • ,_.
the
Po\ver ÜBSÍpation safet>- oíthe tíevice cannct t«t guarartfcíti.-xcaESfct "Qp-fabrg Tati^íera-
_ ,. , . 7nr. ,., tute Range' Ciey ate not mear» :o ímply swimotíe^c^sKwutí be cp«t-
uua-in-une /uu mv/ ^^ 3, y^^ lim¡Lj_ ^^ at.te 0( -=^^,.,,3, cnarstrertar-cs- piwícts
Small Outline 500 mVV condttíons for aclual üevice operaüon.
DC Eíecírical Characteristics
MSn/Max (hirts appiy SCTCSS leniperaure tange unJess csher^se noietí
Symboi Paiametor Ccmdhlons { wln | Typ fisax ( Units
I t
CMOSTOCiWCS
viKD Logical T Inpií Votiage Vcc-5V 3.5 V
Vcc=10V a,o V
Lo^cal *0" !npu( Vtoüage Vcc-5V 1.5 y
V!HiO)
VOUT{1J Lógica! "1* Outpm Volíage Vcc = 4.75V. ÍQ =- 360 JlA VCG-O.-I V
VCC-4.75V. !0=-l.6mA 2,4 V
vCWT(Oí | Logical '0" DutpW Vdlage Vcc-4.75V.Ioe1.6mA | 0.4 V
OUTPUT DRIVE {Sbort Circuir Currerrl)
ISCMÍCS Oulpul Source Cu'ren! Vcc«5V.V our «OV -12 -2d mA
TA = 25°C(Ncte2J
ISOORCE Oulput Sonrce Cunent vcc=iov,vour=ov -24 -13 mA
TA = 25"C(Nole2>
'sw« Owpui Sinh Currem VCc«5v.vour=vcc 6 12 mA.
(N-Channel) T A =25*C(flote2)
Isníií Output Sínk Cun-ent VCC=IOV.VDUT=VCC 24 48 mA
(H-Channel) TA = 25°C(Note2J
Neto 2: Thase ara peak ouiput currcnl carpa bifíies. Contímious omput cunan fs rated at IZmAmai:.
145
'SET-W
Mínimum Se[-Up Time Data In 'HOLU = °ns
to CtOCKíUTCH EHABLE VCC-EV 70 140 ns
vcc«iov 35 70 ns
v.-v,-wjain:h ildsütní.co
146
Jnpul (Note 7)
CIN Input Capacrtance Any Oíher Input {Hote 7) 5 7.5 PF
CQUT Oulput Capacüance Kígh Impedance 10 15 pF
Stale {Note 7)
Cptj j Poweí EJissipalItxi Capachance Per Package^HoteflJ 250 pF
Hot* ft AC Parameleri at^ guarameed by DC ctxrelaled teslíng.
Not» 7: Copaciíance is suarante^d by peííodc ¡ejtíng.
Nota S: Ca¡j Determines ihe naload ACpowet consumpt'cneí any CMOSdevic*. Fbr cxamptelB explanaren see Famlh/CtiarocíefbtlcsApprcaton Note
AN-90.
www.fb ¡rchiltlsani.com
147
MM74C373
Propagation Delay, Data In to Oirtput
va Load Capaciíance MM74C373, MM74C374
Oulput SInk Currerrt vs VQur
TfflSS
Typical Applications
O
Data Bus Interfacing Element
3-siATC DATA a us
UU7JC373 UU7JC375
OR 0*
ro
U
PDlfHERíl. D£VCE
W V
L
DI a QT
D; 0!
Di 03
OS CR OS
OS WtC. 71 0*
D7 Oí
05 _ 09
CIKAE rj-c
-r-
TI
www.fairch il
O>
MM74C373 • MM74C374
S
3
¿u
I
O)
E
í-
D)
.E
-C
Ü
150
CO
O
r
j.jio^iia ,
RiM-0.7171 ' 1Z.3M-LW1
l
JE T~
Ü2i.^-x
13 rt?) O BI6 -O (teo
»UL£«T« ~lfl.«6- I.Z7C]
T1PAU1£UIS
20-l.ead SmaH Outline Jntegrated Ctrcuít (SOIC), JEDEC MS-013. 0^00" Wide
Package Number ^A20S
b! ldsenii.com
151
!_ I.3i3-u»a ¡ O
OJ
m
O
o
O
i
£
TS
CD
20-Lead Plástic DuaJ-Jn-Une Package (PD!P), JEDEC MS-001, 0.300" VVIde
r~
Pacicage Number N20A cu
i-»-
o
-»
OJ
¿5
H
m
O
o
-o
^CD
TJ
•o'
i
33
o
LIFESUPPORTPOLICY
FAIRCHILD'S PRODUCTS ARE NOT AUTHORIZED FOR USE AS CRITICA1. COMPONENTS IN LIFE SUPPORT
DEVICES OR SYSTEMS WITHOUT THE EXPRESS WRITTEN APPROVAL OF THE PRESIDENT OF FAIRCHILO
SEMICONDUCTOR CORPORATION. As used herein:
1. Lifesupportdevícesorsyslems are de-^ces orsj'Stefns 2. A critica] component in any component of a life support
whlch. (a) are ínfended for surgica! implanl ínfo ihe device or sysíem v/hose iailure to perform can be rea-
body, or {b} suppcrt ar sustaín Ufe, and (c) whose faílure sonably expecíed to cause [he feilure of the íífe support
to perform when properly used in accordance wiíh de-^íce or sysíem. or to affecí its saüaty or effectiveness.
instructions for use províded in the labeting, can be rea-
sonabíy expected \o jesulí in a significant injury ío íhe www.fairchikfsemi.com
user.
152
ANEXO No. 7
S
r^ r\ r~> f~*~ i j | ( f~~\B
October iaa/ E:
Revised January 1999 !¿
SEMICONDUCTOR 7?.- o
o
K)
CO
MM74C922 * MM74C923 *
m
Ordering Code:
o
Q
Order Number Package Nurnber Package Description Q.
CD
MM74C922N N 16A 18-Lead Plástic Dual-ln-ü'ne Package (PD1PJ, JEDEC MS-00 1 , 0.300^ Wide -í
MM74C922WM M20B 20-Lead Small OuUine Integrated Circuil (SOIC), JEDEC MS-013. 0.300' Wide
MM74C923WM M20B 20-Lead Smal! Oullíne Inlegraled Clrcuii (SOIC), JEDEC MS-013, 0.300' Wide
MM74C923N N20A 20-Lead Plástic DuaNn-Line Package (PDIP) , JEDSC MS-00 1. 0.300" Wide
Oevlce also available inTape andRsel. Sp«ci!y by appending suffiíc lettef 'X'toine oitíeting code.
Connection Diagrams
Pin Assignment forDIP Pin Assignmentfor SOIC
Top Víew
MM94C922
co
CM
O) Coiinection Diagrams (Continued)
O Pin Assignment for
DJPand SO1C Package
R0* VI — VEC
ROKYI — — OATAOtíTA
O-J na-tín — — MTA OUT s
CN)
OJ nwii — — untaaurc
U RDKVS— lí-OATAOÜIO
OSCÍLl/lIOH — — OrtTA C1IT E
KEYlOL'KCE.'iAI»; — — QU1PUIE.XRH.Í
C011WMX3 — — CQiUMIIJ
BKO — — COLUMHX2
Top Víew
MH74C923
Tru th Jabíes
(Pins 0 through 11)
SwUch 0 1 2 3 4 5 6 7 8 9 1 0 1 1
Posttion Y1.X1 Y1.X2 Y1PC3 Y1.X4 Y2.X1 Y2^C2 Y2.X3 Y2.X4 Y3.X1 Y3^C2 Y3.X3 Y3,X4
D
A A 0 1 0 1 0 1 0 1 0 1 0 1
T B 0 0 1 1 0 0 1 1 0 0 1 1
A C 0 0 0 0 1 1 1 1 0 0 0 0
O D 0 0 0 0 0 0 0 0 1 1 1 1
U E (Note 1) 0 0 0 0 0 0 0 0 0 0 0 0
T
Not«1:Om'íforMM74C922
154
Block Diagram
O
CD
SJ
ÍO
O
CD
áírehilítscmi.com
155
ro
CM
Oí AbSOlute Máximum RatÍngS(Nols2) Operating Vcc Range 3VÍQ15V
O vcc iav
Vbltage at Any Pin V cc ~0.3Vio V CC + Q.3V ^
Lead Temperature
Operaiing Temperaíure Range ,„ , , . ,, „
^ ÍSoidering, lOseconds) 260-C
MM74C922, MM74C923 ~40;C io +S5°C x a '
Storage Temperatura Range -65=C ta -i-1 50SC „ .L L , . „ . . , L , L-
r Not« 2: Absciuie Máximum Ratngs" are mese vafees b^ycnd wh«i oe
CM Power Dissípatíon (P Q) safer/ oftt¡e¿ev« cannct be guáramele. Excapí far "Opetaiing Tempeta-
en .-. , , i .
UUai-in-Line
___. ...
/ü(J mW
Uire Ranga" thfey ate ntn meant to Vnply ttiaí tne devices snoukj D« oper-
gled a[ |{)ese !Jm!ls_ 71)e uye Q( -c'^.,,-.^, ctiaractsnsiics- ptoviries
O Small Outlíne 500 mW condíHora fcrf actual device operaiion.
DC Eíectrical Characteristics
M!n/MaxlimlsaDp)yacfosslemceraíurerartge unlessühems«specified
Symbol Para meter Condttíons Mln Typ Max Unhs
CMOS TO CMOS
VT^ Posilive-Gcirig ThceshoW Voila^e Vcc = 5V. l|Ha0.7mA 3.0 3.6 4.3 V
al Ose and KBM Inpus Vcc=10V.!|t,S.l.4mA 6.0 6.8 8.6 V
Vcc=15V.!(N^2.-lrM 9.0 10 12.9 V
VT_ Negallve-Going Threshald Vottage Vcc=5V.iiriS0.7mA 0.7 1.4 2.0 V
at Ose and KBM triputs Vcc=lOV.l|MS;l.4nv^ 1.4 3.2 J.Q V
VCc='í5V.ljN^2.1fnA 2.1 5 6.0 V
V|H{i) Logical "1" Input Xbttage, Vcc = 5V 3.5 4.5 V
Excepl Ose and KBM Ifiputs Vcc = 10V a.o 9 V
Vcc=15V 12.5 13.5 V
Vl»[0)
Lógica! "Q" Inpul Wtage, VCC=5V 0.5 1.5 V
Except Ose and KBM Inputs Vcc=10V 1 2
Vcc=15V 1.5 Z5 V
-20
|iA
Y3, Y4 and Y5 Ircute Vcc=10V -10 jiA
Vcc=15V -22 -45 fiA
VoOTfi) LogJcsl "1* Output Vcítage Vcc = 5V, lo = -10fiA 4.5 V
Vcc=IOV.!o=-10íiA 9 V
Vcc=l5V.lQ = -1QPA 13.5 V
VOUT(OJ
Lr^cs! "G* Oiflput 'ítttage VCC = 5V.t 0 =10'iA 0.5 V
VCC=IOV,ÍO=^IIA 1 V
Vcc^l^Jo 3 ^^ 1.5 V
Ron Column "ON" Resistance at V CC =5V 1 V 0 =Q.5V SCO 14CO n
X1. X2, X3 3,-xi X4 Ouiputs VCC=1CV,V0=1V 300 7CO n
Va:=l5V,Vo:i1.5V 200 500 n
'ce Supply Cucrenl VCG-SV 0.55 1.1 mA
Csc at OV, (one Y !cw) V'cc= 10V 1.1 1.9 mA
Vcc^lSV 1.7 2.6 mA.
'lN(l)
Logical "T Inpot Curfent Vcc-15V.V w »1SV O.C05 1.0 pA
al Oütput Enante
I|N(0) Logícal '0" Inpw Curreni Vcc-15V.V w = CV -1.0 -O.C05 t¡A
al Outpirt Enable
CMOS/LPTTU 1HTERFACE
ljliN(l) Except Ose and KBM íncuts [ Vcc = 4-751-/ Vcc -1.5 | V
VIN(0)
Except Ose and KBM Irtputs VQ; = J-75V O.S V
VO/T(Í)
Logical TQírtpt/tVoftage !Q = -36Ü ^A
2
DC Eiectrical Characteristics (continuad)
(N-Chatinei) to
ISINK Outpul S¡nk Cuirenl Vcc = 10V.Vour = Vcc, 8 16 mA GJ
(H-Crianne)J TA = 25°C
'OH- IIH Propagalfori De!ay Time froro RL= 10k. 0^= 10 pF {Figure 2}
Lógica! "0" or Lógica! "1" VCG = 5V.R t _=lOk 80 200 ns
¡nto Hlgh ¡mpedance Slale Vcc=10V.C L =10pF 65 150 ns
VCC = 151/ 50 110 ns
co
04
en Switchíng Time Waveforms
O
en
O
TI - T2 - RC, T3 - 0.7 RC, whera R- lOk and C b extsrnal capacitor al K8M ínput
FIGURE 1.
\E
VCL
FIGURE 2.
'•''*•
xvw. fairc h ildsemi. co m
158
O
co
0.01 0.1
Typical Applications
Synchronous Hancishake (MM74C922) Synchronous Data Entry Onta Bus (MM74C922)
OATAAVAtUStE
EHMLE Q
IR ESTO -íS E)
CM
c-J
o
O
->- OATAAVAIUBLE
oscj^ TOE
TCU<J
Oulputs are [n 3-STATE until key b preased. «7«n dala te placed o« bus. Wtien key is jeleased, outpirtsfefiJrn to3-STATH.
Theory of Operation
The MM74C922/MM74C923 Keyboard Enccders ¡mple- going low also inllíates Ihe key bounce circuil Ütning and
menl al! tfie logic necessary to interface a 16 or 20 SPST locks oul the olher Y inputs. The key cade lo be output is a
key s//iích matñx to a dígita! system. The encoder will con- combination of the frozen counter valué and the decoded Y
vert a key s\vitch doser to a 4{MM74C922) or inputs. Once the key bounce drcuíl times oul, Ihe data is
5{MM74C923) bit nibble. The desgner can contrd bolh the latched, and the Data Avaiíabie (DAV) cutput gees high.
keyboard sean rate and Ihe key debounce period by alter- lí, during the key cfosure the switch bounces, Y1 ínput will
Ing Ihe osdilalor capacitor, CQS^, and Ihe key bounce go high again, restarting the sean and resettíng the key
mask capadtor, Cf,,SK. Thus, the MM74C922/MM74C923's bounce drcuilry, The key may bounce several times, bul as
performance can be optimized for many keyboards, soon as Ihe switch stays low for a debounce period, Ihe
The keyboard encodeis connect to a swítch matrix that !s 4 dosure is assumed valid and the data ¡s lafched.
rows by 4 cofumns (MM74C922J or 5 rows by 4 columns A key may also bautice when it Es released. To ensure Ihat
(MM74C923). When no keys are depressed, the rcw ínpuls the encoder does not reccgnize this bounce as another key
are pulled hígh by internal pu!I-ups and the column outputs dosure, the debounce circuil must üme out before another
sequentlally output a togic "O". These outputs are open dosure is reccgnízed.
draín and are therefore tow for 25% of Ihe (¡me and olher- The Ewo-key roll-ov«r feaíure can be iDustrated by assum-
wíse off. The column sean rate is conlrolled by ihe osdila- Ing a key is depressed, and then a second key fe
lor fnpul, '/íhich consísts of a SdimlU Irigger osdliator, a 2- depressed. Since all scanníng has stcpped, and a!! olher Y
blt counter, and a 2—í-bit deccder. inputs are dcsabled, the second key is not recognízed unlil
When a key is depressed, key O, for example, nothlng wiH the ftrst key is lifted and the key bounce circuitry has reseL
happen when the XI input is off, since Y1 will remain high. The output latches feed 3-STATE, which is enabted when
When the X1 column fe scanned, X1 goes lev/ and Y1 will the Outpul Enable (OE) ínput is laken lew.
go !ow. This disabies Ihe counler and keeps X1 tow. Y1
O
to
O
co
o.ooa-o.ou,
[0.20-0.36]
(Iiis»_i3.»ai]
, IS H U
1 ¡ñ ñ ñ ñ ñ ñ ñ ñ ñ
yyüuuuuyu
JE 1
1
0016 -3 DM ' Tris
[S.3UI J
—i ^
r*~ ,,j~
L .p-^J-^-jg.1
J.TOTT?
¡•-?OH
1 (iirc-tzri) fi
162
ANEXO No. 8
FILTROS ECUAUZADORES
Parámetros
TS .- 4SOÍK)
k = i .. 10
k *>„= **••= g,
a
.= 20
expl, -= rff¡í f g.
120 i í 60 i r k ^k
1
200 j flOO !
~¿r
u—, 400 | I20ÍJ ¡
¡3 SOO •400 1
4 1500 i75Qj
3CXX) ;1500j
"5
6000 J3000J
6 12000 .6000] -L-exp3. ~exp2,.
r-M i i/i K K
7 14000 ptJOOj Go, := l i o 20 G, fs
8 [6000 JSQOQ j
9 i
„ ¿f,k Aw,
Aw,, := 2-71-
(G^) 2 - 1 -tan
10¡
ir
eos /^wo, ^
31, := -2- V-
" B *> ' Alk-=-B A2,. := -
1+
£ 10.929018
Í0.858939
í- 1.986413
¡ -1.971647
1.058077J
1.115413Í
-0.987094
- 0.974353
1.986413
1.971647
:T ¡0.721404 r 1.938668 1.227942J -0.949346 1.938668
0.488678 {-1.870389 1.418354; -0.907032 1,870389
0.020627 j- 1.683246 1.801305 -0.821932 1.683246
7 1-0.813322 j-1.181084 2.483527| - 0.670305 1.181084
[-•2.204305 '! n<i 3.621704! -0.417399 0 ^
!-2~614285 i 0.347557 3.9571 42j -0.342857 -0.347557
¡10 |- 3.006638 í 0.63576 4.278159J -0.27152 - 0.63576
32,
B1,
BO,
A1,
163
REFERENCIA BIBLIOGRÁFICA
xü. RABÍNER, Lawrence R., " Digital Signal Processing ", IEEE Press,
edición New York 1972.
xx i. Internet http://www.fiee.uni.edu.pe